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参数资料
型号： ADSP-BF547BBCZ-5A
厂商： Analog Devices Inc
文件页数： 63/100页
文件大小： 0K
描述： IC DSP 16BIT 533MHZ 400CSBGA
产品培训模块： Blackfin® Processor Core Architecture Overview
Blackfin® Device Drivers
Blackfin® Optimizations for Performance and Power Consumption
Blackfin® System Services
标准包装： 1
系列： Blackfin®
类型： 定点
接口： SPI，SSP，TWI，UART，USB
时钟速率： 533MHz
非易失内存： 外部
芯片上RAM： 260kB
电压 - 输入/输出： 2.50V，3.30V
电压 - 核心： 1.25V
工作温度： -40°C ~ 85°C
安装类型： 表面贴装
封装/外壳： 400-LFBGA，CSPBGA
供应商设备封装： 400-CSPBGA（17x17）
包装： 托盘
配用： ADZS-BF548-EZLITE-ND - KIT EZLITE ADZS-BF548
ADSP-BF542/ADSP-BF544/ADSP-BF547/ADSP-BF548/ADSP-BF549
Rev. C
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February 2010
Serial Peripheral Interface (SPI) Port—Slave Timing
Table 46 and Figure 39 describe SPI port slave operations.
Table 46. Serial Peripheral Interface (SPI) Port—Slave Timing
Parameter
Min
Max
Unit
Timing Requirements
tSPICHS
SPIxSCK High Period
2tSCLK –1.5
ns
tSPICLS
SPIxSCK Low Period
2tSCLK –1.5
ns
tSPICLK
SPIxSCK Period
4tSCLK
ns
tHDS
Last SPIxSCK Edge to SPIxSS Not Asserted
2tSCLK –1.5
ns
tSPITDS
Sequential Transfer Delay
2tSCLK–1.5
ns
tSDSCI
SPIxSS Assertion to First SPIxSCK Edge
2tSCLK –1.5
ns
tSSPID
Data Input Valid to SPIxSCK Edge (Data Input Setup)
1.6
ns
tHSPID
SPIxSCK Sampling Edge to Data Input Invalid
1.6
ns
Switching Characteristics
tDSOE
SPIxSS Assertion to Data Out Active
0
8
ns
tDSDHI
SPIxSS Deassertion to Data High Impedance
0
8
ns
tDDSPID
SPIxSCK Edge to Data Out Valid (Data Out Delay)
10
ns
tHDSPID
SPIxSCK Edge to Data Out Invalid (Data Out Hold)
0
ns
Figure 39. Serial Peripheral Interface (SPI) Port—Slave Timing
tSPICLK
tHDS
tSPITDS
tSDSCI
tSPICLS
tSPICHS
tDSOE
tDDSPID
tDSDHI
tHDSPID
tSSPID
tDSDHI
tHDSPID
tDSOE
tHSPID
tSSPID
tDDSPID
SPIxSS
(INPUT)
SPIxSCK
(INPUT)
SPIxMISO
(OUTPUT)
SPIxMOSI
(INPUT)
SPIxMISO
(OUTPUT)
SPIxMOSI
(INPUT)
CPHA = 1
CPHA = 0
tHSPID
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