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参数资料
| 型号： | ADSP-BF547YBCZ-4A |
| 厂商： | Analog Devices Inc |
| 文件页数： | 61/100页 |
| 文件大小： | 0K |
| 描述： | IC DSP BLACKFIN 400MHZ 400CSPBGA |
| 标准包装： | 1 |
| 系列： | Blackfin® |
| 类型： | 定点 |
| 接口： | SPI，SSP，TWI，UART，USB |
| 时钟速率： | 400MHz |
| 非易失内存： | 外部 |
| 芯片上RAM： | 260kB |
| 电压 - 输入/输出： | 2.50V，3.30V |
| 电压 - 核心： | 1.25V |
| 工作温度： | -40°C ~ 105°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 400-LFBGA，CSPBGA |
| 供应商设备封装： | 400-CSPBGA（17x17） |
| 包装： | 托盘 |
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ADSP-BF542/ADSP-BF544/ADSP-BF547/ADSP-BF548/ADSP-BF549
Rev. D
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|
May 2011
Serial Peripheral Interface (SPI) Port—Master Timing
Table 44. Serial Peripheral Interface (SPI) Port—Master Timing
Parameter
Min
Max
Unit
Timing Requirements
tSSPIDM
Data Input Valid to SPIxSCK Edge (Data Input Setup)
9.0
ns
tHSPIDM
SPIxSCK Sampling Edge to Data Input Invalid
–1.5
ns
Switching Characteristics
tSDSCIM
SPIxSELy Low to First SPIxSCK Edge
2tSCLK–1.5
ns
tSPICHM
SPIxSCK High Period
2tSCLK–1.5
ns
tSPICLM
SPIxSCK Low Period
2tSCLK–1.5
ns
tSPICLK
SPIxSCK Period
4tSCLK–1.5
ns
tHDSM
Last SPIxSCK Edge to SPIxSELy High
2tSCLK–1.5
ns
tSPITDM
Sequential Transfer Delay
2tSCLK–1.5
ns
tDDSPIDM
SPIxSCK Edge to Data Out Valid (Data Out Delay)
6
ns
tHDSPIDM
SPIxSCK Edge to Data Out Invalid (Data Out Hold)
–1.0
ns
Figure 38. Serial Peripheral Interface (SPI) Port—Master Timing
tSDSCIM
tSPICLK
tHDSM
tSPITDM
tSPICLM
tSPICHM
tHDSPIDM
tHSPIDM
tSSPIDM
SPIxSELy
(OUTPUT)
SPIxSCK
(OUTPUT)
SPIxMOSI
(OUTPUT)
SPIxMISO
(INPUT)
SPIxMOSI
(OUTPUT)
SPIxMISO
(INPUT)
CPHA = 1
CPHA = 0
tDDSPIDM
tHSPIDM
tSSPIDM
tHDSPIDM
tDDSPIDM
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