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参数资料
| 型号： | ADT7463ARQZ-REEL |
| 厂商： | ON Semiconductor |
| 文件页数： | 38/50页 |
| 文件大小： | 726K |
| 描述： | IC REMOTE THERMAL CTRLR 24-QSOP |
| 产品变化通告： | MFG CHG Notification ADI to ON Semi QSOP 24ld Pkg (MSL) Change 17/Jun/2010 |
| 标准包装： | 2,500 |
| 系列： | dBCool® |
| 功能： | 风扇控制，温度监控器 |
| 传感器类型： | 内部和外部 |
| 感应温度： | -40°C ~ 120°C，外部传感器 |
| 精确度： | ±1.5°C（最小值） |
| 拓扑： | ADC，比较器，风扇速度计数器，多路复用器，寄存器库 |
| 输出类型： | SMBus? |
| 输出警报： | 无 |
| 输出风扇： | 是 |
| 电源电压： | 3 V ~ 5.5 V |
| 工作温度： | -40°C ~ 120°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 24-SSOP（0.154"，3.90mm 宽） |
| 供应商设备封装： | 24-QSOP |
| 包装： | 带卷 (TR) |
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ADT7463
http://onsemi.com
38
Table 52. REGISTER 0X37 DYNAMIC T
MIN
CONTROL REGISTER 2 (POWERON DEFAULT = 0X00) (Note 1)
Bit
Name
R/W
Description
<2:0>
CYR1
R/W
3bit Remote 1 Cycle Value. These three bits define the delay time between making subsequent
T
MIN
adjustments in the control loop for the Remote 1 channel, in terms of number of monitoring
cycles. The system has associated thermal time constants that need to be found to optimize the
response of fans and the control loop.
Bits
Decrease Cycle
Increase Cycle
000
4 Cycles (0.5 s)
8 Cycles (1 s)
001
8 Cycles (1 s)
16 Cycles (2 s)
010
16 Cycles (2 s)
32 Cycles (4 s)
011
32 Cycles (4 s)
64 Cycles (8 s)
100
64 Cycles (8 s)
128 Cycles (16 s)
101
128 Cycles (16 s)
256 Cycles (32 s)
110
256 Cycles (32 s)
512 Cycles (64 s)
111
512 Cycles (64 s)
1024 Cycles (128 s)
<5:3>
CYL
R/W
3bit Local Temperature Cycle Value. These three bits define the delay time between making
subsequent T
MIN
adjustments in the control loop for local temperature channel, in terms of
number of monitoring cycles. The system has associated thermal time constants that need to
be found to optimize the response of fans and the control loop.
Bits
Decrease Cycle Increase Cycle
000
4 Cycles (0.5 s)
8 Cycles (1 s)
001
8 Cycles (1 s)
16 Cycles (2 s)
010
16 Cycles (2 s)
32 Cycles (4 s)
011
32 Cycles (4 s)
64 Cycles (8 s)
100
64 Cycles (8 s)
128 Cycles (16 s)
101
128 Cycles (16 s) 256 Cycles (32 s)
110
256 Cycles (32 s) 512 Cycles (64 s)
111
512 Cycles (64 s) 1024 Cycles (128 s)
<7:6>
CYR2
R/W
2 LSBs of 3bit Remote 2 Cycle Value. The MSB of the 3bit code resides in Dynamic T
MIN
Control Register 1 (Reg. 0x36). These three bits define the delay time between making
subsequent T
MIN
adjustments in the control loop for the Remote 2 channel, in terms of number
of monitoring cycles. The system has associated thermal time constants that need to be found
to optimize the response of fans and the control loop.
Bits
Decrease Cycle Increase Cycle
000
4 Cycles (0.5 s)
8 Cycles (1 s)
001
8 Cycles (1 s)
16 Cycles (2 s)
010
16 Cycles (2 s)
32 Cycles (4 s)
011
32 Cycles (4 s)
64 Cycles (8 s)
100
64 Cycles (8 s)
128 Cycles (16 s)
101
128 Cycles (16 s) 256 Cycles (32 s)
110
256 Cycles (32 s) 512 Cycles (64 s)
111
512 Cycles (64 s) 1024 Cycles (128 s)
1. This register becomes readonly when the Configuration Register 1 Lock bit is set to 1. Further attempts to write to this register have no effect.
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PDF描述 |
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参数描述 |
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