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参数资料
| 型号： | ADT7468ARQZ-REEL |
| 厂商： | ON Semiconductor |
| 文件页数： | 66/81页 |
| 文件大小： | 0K |
| 描述： | IC REMOTE THERMAL CTRLR 24QSOP |
| 产品变化通告： | MFG CHG Notification ADI to ON Semi Product Obsolescence 11/Feb/2009 |
| 标准包装： | 2,500 |
| 系列： | dBCool® |
| 功能： | 风扇控制，温度监控器 |
| 传感器类型： | 内部和外部 |
| 感应温度： | -40°C ~ 120°C，外部传感器 |
| 精确度： | ±2°C（最小值） |
| 拓扑： | ADC，比较器，风扇速度计数器，多路复用器，寄存器库 |
| 输出类型： | SMBus? |
| 输出警报： | 无 |
| 输出风扇： | 是 |
| 电源电压： | 3 V ~ 5.5 V |
| 工作温度： | -40°C ~ 120°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 24-SSOP（0.154"，3.90mm 宽） |
| 供应商设备封装： | 24-QSOP |
| 包装： | 带卷 (TR) |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页当前第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页
ADT7468
Table 24. Register 0x37—Dynamic T MIN Control Register 2 (Power-On Default = 0x00) 1
Bit
<2:0>
Name
CYR1
R/W
Read/write
Description
3-Bit Remote 1 Cycle Value. These three bits define the delay time between making subsequent T MIN
adjustments in the control loop for the Remote 1 channel, in terms of number of monitoring cycles. The
system has associated thermal time constants that need to be found to optimize the response of fans and
the control loop.
Bits
000
Decrease Cycle
8 cycles (1 sec)
Increase Cycle
16 cycles (2 sec)
001
16 cycles (2 sec ) 32 cycles (4 sec)
010
011
32 cycles (4 sec)
64 cycles (8 sec)
64 cycles (8 sec)
128 cycles (16 sec)
100
101
110
111
128 cycles (16 sec) 256 cycles (32 sec)
256 cycles (32 sec) 512 cycles (64 sec)
512 cycles (64 sec) 1024 cycles (128 sec)
1024 cycles (128 sec) 2048 cycles (256 sec)
<5:3>
CYL
Read/write
3-bit local temperature cycle value. These three bits define the delay time between making subsequent T MIN
adjustments in the control loop for the local temperature channel, in terms of number of monitoring cycles.
The system has associated thermal time constants that need to be found to optimize the response of fans
and the control loop.
Bits
000
001
010
011
Decrease Cycle
8 cycles (1 sec)
16 cycles (2 sec)
32 cycles (4 sec)
64 cycles (8 sec)
Increase Cycle
16 cycles (2 sec)
32 cycles (4 sec)
64 cycles (8 sec)
128 cycles (16 sec)
100
101
110
111
128 cycles (16 sec) 256 cycles (32 sec)
256 cycles (32 sec) 512 cycles (64 sec)
512 cycles (64 sec) 1024 cycles (128 sec)
1024 cycles (128 sec) 2048 cycles (256 sec)
<7:6>
CYR2
Read/write
2 LSBs of 3-bit Remote 2 cycle value. The MSB of the 3-bit code resides in Dynamic T MIN Control Register 1
(Reg. 0x36). These three bits define the delay time between making subsequent T MIN adjustments in the
control loop for the Remote 2 channel, in terms of number of monitoring cycles. The system has associated
thermal time constants that need to be found to optimize the response of fans and the control loop.
Bits
000
001
010
011
100
101
110
111
Decrease Cycle
8 cycles (1 sec)
16 cycles (2 sec)
32 cycles (4 sec)
64 cycles (8 sec)
128 cycles (16 sec)
256 cycles (32 sec)
512 cycles (64 sec)
1024 cycles (128 sec)
Increase Cycle
16 cycles (2 sec)
32 cycles (4 sec)
64 cycles (8 sec)
128 cycles (16 sec)
256 cycles (32 sec)
512 cycles (64 sec)
1024 cycles (128 sec)
2048 cycles (256 sec)
This register becomes read-only when the Configuration Register 1 lock bit is set to 1. Any subsequent attempts to write to this register fail.
1
Table 25. Maximim PWM Duty Cycle (Power-On Default = 0xFF) 1, 2
Register Address
0x38
0x39
0x3A
R/W 2
Read/write
Read/write
Read/write
Description
Maximum duty cycle for PWM1 output, default = 100% (0xFF).
Maximum duty cycle for PWM2 output, default = 100% (0xFF).
Maximum duty cycle for PWM3 output, default = 100% (0xFF).
1
2
These registers set the maximum PWM duty cycle of the PWM output .
This register becomes read-only when the Configuration Register 1 lock bit is set to 1. Any subsequent attempts to write to this register fail.
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PDF描述 |
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参数描述 |
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