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参数资料
| 型号： | ADUC7036DCPZ-RL |
| 厂商： | Analog Devices Inc |
| 文件页数： | 70/132页 |
| 文件大小： | 0K |
| 描述： | IC MCU 96K FLASH DUAL 48LFCSP |
| 标准包装： | 2,500 |
| 系列： | MicroConverter® ADuC7xxx |
| 核心处理器： | ARM7 |
| 芯体尺寸： | 16/32-位 |
| 速度： | 20.48MHz |
| 连通性： | LIN，SPI，UART/USART |
| 外围设备： | PSM，温度传感器，WDT |
| 输入/输出数： | 9 |
| 程序存储器容量： | 96KB（48K x 16） |
| 程序存储器类型： | 闪存 |
| RAM 容量： | 1.5K x 32 |
| 电压 - 电源 (Vcc/Vdd)： | 3.5 V ~ 18 V |
| 数据转换器： | A/D 2x16b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 115°C |
| 封装/外壳： | 48-VFQFN 裸露焊盘，CSP |
| 包装： | 带卷 (TR) |
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ADuC7036
Rev. C | Page 42 of 132
16-BIT, Σ-Δ ANALOG-TO-DIGITAL CONVERTERS
The ADuC7036 incorporates two independent Σ-Δ analog-to-
digital converters (ADCs): the current channel ADC (I-ADC)
and the voltage/temperature channel ADC (V-/T-ADC). These
precision measurement channels integrate on-chip buffering, a
programmable gain amplifier, 16-bit, Σ-Δ modulators, and
digital filtering for precise measurement of current, voltage,
and temperature variables in 12 V automotive battery systems.
CURRENT CHANNEL ADC (I-ADC)
The I-ADC converts battery current sensed through an external
100 μΩ shunt resistor. On-chip programmable gain means that
the I-ADC can be configured to accommodate battery current
levels from ±1 A to ±1500 A.
As shown in Figure 18, the I-ADC employs a Σ-Δ conversion
technique to attain 16 bits of no missing codes performance.
The Σ-Δ modulator converts the sampled input signal into a
digital pulse train whose duty cycle contains the digital infor-
mation. A modified Sinc3, programmable, low-pass filter is
then used to decimate the modulator output data stream to give
a valid 16-bit data conversion result at programmable output
rates from 4 Hz to 8 kHz in normal mode and from 1 Hz to
2 kHz in low power mode.
The I-ADC also incorporates counter, comparator, and accu-
mulator logic. This allows the I-ADC result to generate an
interrupt after a predefined number of conversions has elapsed
or the I-ADC result exceeds a programmable threshold value.
A fast ADC overrange feature is also supported. Once enabled,
a 32-bit accumulator automatically sums the 16-bit I-ADC results.
The time to a first valid (fully settled) result on the current channel
is three ADC conversion cycles with chop mode disabled and
two ADC conversion cycles with chop mode enabled.
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PDF描述 |
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