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参数资料
| 型号： | ADUM1250WSRZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 3/16页 |
| 文件大小： | 0K |
| 描述： | IC ISOLATOR 1MBPS 4CH 2.5K 8SOIC |
| 标准包装： | 98 |
| 系列： | iCoupler® |
| 输入 - 1 侧/2 侧： | 2/2 |
| 通道数： | 4 |
| 电源电压： | 3 V ~ 5.5 V |
| 电压 - 隔离： | 2500Vrms |
| 数据速率： | 1Mbps |
| 传输延迟： | 150ns |
| 输出类型： | I²C? |
| 封装/外壳： | 8-SOIC（0.154"，3.90mm 宽） |
| 供应商设备封装： | 8-SO |
| 包装： | 管件 |
| 工作温度： | -40°C ~ 125°C |
Data Sheet
ADuM1250/ADuM1251
SPECIFICATIONS
ELECTRICAL CHARACTERISTICS
DC Specifications 1
All minimum/maximum specifications apply over the entire recommended operating range, unless otherwise noted. All typical specifications
are at T A = 25°C, V DD1 = 3.3 V or 5 V, and V DD2 = 3.3 V or 5 V, unless otherwise noted.
Table 1.
Parameter
Symbol
Min
Typ
Max
Unit
Test Conditions/Comments
ADuM1250
Input Supply Current, Side 1, 5 V
Input Supply Current, Side 2, 5 V
Input Supply Current, Side 1, 3.3 V
Input Supply Current, Side 2, 3.3 V
I DD1
I DD2
I DD1
I DD2
2.8
2.7
1.9
1.7
5.0
5.0
3.0
3.0
mA
mA
mA
mA
V DD1 = 5 V
V DD2 = 5 V
V DD1 = 3.3 V
V DD2 = 3.3 V
ADuM1251
Input Supply Current, Side 1, 5 V
Input Supply Current, Side 2, 5 V
Input Supply Current, Side 1, 3.3 V
Input Supply Current, Side 2, 3.3 V
LEAKAGE CURRENTS
I DD1
I DD2
I DD1
I DD2
I SDA1 , I SDA2 ,
I SCL1 , I SCL2
2.8
2.5
1.8
1.6
0.01
6.0
4.7
3.0
2.8
10
mA
mA
mA
mA
μA
V DD1 = 5 V
V DD2 = 5 V
V DD1 = 3.3 V
V DD2 = 3.3 V
V SDA1 = V DD1 , V SDA2 = V DD2 ,
V SCL1 = V DD1 , V SCL2 = V DD2
SIDE 1 LOGIC LEVELS
Logic Input Threshold 2
V SDA1T , V SCL1T
500
700
mV
Logic Low Output Voltages
Input/Output Logic Low Level Difference 3
V SDA1OL , V SCL1OL
ΔV SDA1 , ΔV SCL1
600
600
50
900
850
mV
mV
mV
I SDA1 = I SCL1 = 3.0 mA
I SDA1 = I SCL1 = 0.5 mA
SIDE 2 LOGIC LEVELS
Logic Low Input Voltage
Logic High Input Voltage
V SDA2IL , V SCL2IL
V SDA2IH , V SCL2IH
0.7 V DD2
0.3 V DD2
V
V
Logic Low Output Voltage
V SDA2OL , V SCL2OL
400
mV
I SDA2 = I SCL2 = 30 mA
1
2
3
All voltages are relative to their respective ground.
V IL < 0.5 V, V IH > 0.7 V.
ΔV S1 = V S1OL ? V S1T . This is the minimum difference between the output logic low level and the input logic threshold within a given component. This ensures that there
is no possibility of the part latching up the bus to which it is connected.
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PDF描述 |
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参数描述 |
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