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参数资料
| 型号： | ADUM1301CRWZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 9/32页 |
| 文件大小： | 0K |
| 描述： | IC DIGITAL ISOLATOR 3CH 16-SOIC |
| 其它图纸： | ADUMx301 Series Diagram |
| 标准包装： | 47 |
| 系列： | iCoupler® |
| 输入 - 1 侧/2 侧： | 2/1 |
| 通道数： | 3 |
| 电源电压： | 2.7 V ~ 5.5 V |
| 电压 - 隔离： | 2500Vrms |
| 数据速率： | 120Mbps |
| 传输延迟： | 27ns |
| 输出类型： | 逻辑 |
| 封装/外壳： | 16-SOIC（0.295"，7.50mm 宽） |
| 供应商设备封装： | 16-SOIC W |
| 包装： | 管件 |
| 工作温度： | -40°C ~ 105°C |
| 产品目录页面： | 2766 (CN2011-ZH PDF) |
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Data Sheet
ADuM1300/ADuM1301
Parameter
Symbol
Min
Typ
Max Unit
Test Conditions
90 Mbps (CRW Grade Only)
V DD1 Supply Current
I DD1 (90)
5 V/3 V Operation
3 V/5 V Operation
43
24
57
36
mA
mA
45 MHz logic signal freq.
45 MHz logic signal freq.
V DD2 Supply Current
I DD2 (90)
5 V/3 V Operation
3 V/5 V Operation
16
29
23
37
mA
mA
45 MHz logic signal freq.
45 MHz logic signal freq.
For All Models
Input Currents
I IA , I IB , I IC , I E1 , I E2 ?10
+0.01
+10
μA
0 V ≤ V IA , V IB , V IC ≤ V DD1 or V DD2 ,
0 V ≤ V E1 , V E2 ≤ V DD1 or V DD2
Logic High Input Threshold
V IH , V EH
5 V/3 V Operation
3 V/5 V Operation
Logic Low Input Threshold
5 V/3 V Operation
3 V/5 V Operation
V IL , V EL
2.0
1.6
0.8
0.4
V
V
V
V
Logic High Output Voltages
V OAH , V OBH , V OCH (V DD1 or V DD2 ) ? 0.1 (V DD1 or V DD2 )
(V DD1 or V DD2 ) ? 0.4 (V DD1 or V DD2 ) ? 0.2
V
V
I Ox = ?20 μA, V Ix = V IxH
I Ox = ?4 mA, V Ix = V IxH
Logic Low Output Voltages
V OAL , V OBL , V OCL
0.0
0.04
0.2
0.1
0.1
0.4
V
V
V
I Ox = 20 μA, V Ix = V IxL
I Ox = 400 μA, V Ix = V IxL
I Ox = 4 mA, V Ix = V IxL
SWITCHING SPECIFICATIONS
ADuM130xARW
Minimum Pulse Width 2
Maximum Data Rate 3
PW
1
1000 ns
Mbps
C L = 15 pF, CMOS signal levels
C L = 15 pF, CMOS signal levels
Propagation Delay 4
t PHL , t PLH
50
70
100 ns
C L = 15 pF, CMOS signal levels
Pulse Width Distortion, |t PLH ? t PHL | 4
Change vs. Temperature
Propagation Delay Skew 5
Channel-to-Channel Matching 6
PWD
t PSK
t PSKCD /t PSKOD
11
40 ns
ps/°C
50 ns
50 ns
C L = 15 pF, CMOS signal levels
C L = 15 pF, CMOS signal levels
C L = 15 pF, CMOS signal levels
C L = 15 pF, CMOS signal levels
ADuM130xBRW
Minimum Pulse Width 2
Maximum Data Rate 3
PW
10
100
ns
Mbps
C L = 15 pF, CMOS signal levels
C L = 15 pF, CMOS signal levels
Propagation Delay 4
Pulse Width Distortion, |t PLH ? t PHL | 4
t PHL , t PLH
PWD
15
35
50
3
ns
ns
C L = 15 pF, CMOS signal levels
C L = 15 pF, CMOS signal levels
Change vs. Temperature
5
ps/°C
C L = 15 pF, CMOS signal levels
Propagation Delay Skew 5
Channel-to-Channel Matching, Codirectional
t PSK
t PSKCD
6
3
ns
ns
C L = 15 pF, CMOS signal levels
C L = 15 pF, CMOS signal levels
Channels 6
Channel-to-Channel Matching, Opposing-
t PSKOD
22
ns
C L = 15 pF, CMOS signal levels
Directional Channels 6
ADuM130xCRW
Minimum Pulse Width 2
Maximum Data Rate 3
PW
90
8.3
120
11.1 ns
Mbps
C L = 15 pF, CMOS signal levels
C L = 15 pF, CMOS signal levels
Propagation Delay 4
Pulse Width Distortion, |t PLH ? t PHL | 4
t PHL , t PLH
PWD
20
30
0.5
40 ns
2 ns
C L = 15 pF, CMOS signal levels
C L = 15 pF, CMOS signal levels
Change vs. Temperature
Propagation Delay Skew 5
Channel-to-Channel Matching,
t PSK
t PSKCD
3
ps/°C
14 ns
2 ns
C L = 15 pF, CMOS signal levels
C L = 15 pF, CMOS signal levels
C L = 15 pF, CMOS signal levels
Codirectional Channels 6
Channel-to-Channel Matching,
t PSKOD
5
ns
C L = 15 pF, CMOS signal levels
Opposing-Directional Channels 6
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