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参数资料
| 型号： | ADUM3442CRWZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 8/24页 |
| 文件大小： | 0K |
| 描述： | IC DIGITAL ISOLATOR 2INP 16SOIC |
| 其它图纸： | ADUMx4 Series Quad Block Diagram |
| 标准包装： | 47 |
| 系列： | iCoupler® |
| 输入 - 1 侧/2 侧： | 2/2 |
| 通道数： | 4 |
| 电源电压： | 3 V ~ 5.5 V |
| 电压 - 隔离： | 2500Vrms |
| 数据速率： | 150Mbps |
| 传输延迟： | 36ns |
| 输出类型： | 逻辑 |
| 封装/外壳： | 16-SOIC（0.295"，7.50mm 宽） |
| 供应商设备封装： | 16-SOIC W |
| 包装： | 管件 |
| 工作温度： | -40°C ~ 105°C |
| 产品目录页面： | 2766 (CN2011-ZH PDF) |
ADuM3440/ADuM3441/ADuM3442
Data Sheet
Parameter
Symbol
Min
Typ
Max
Unit
Test Conditions
150 Mbps
V DD1 Supply Current
I DD1 (150)
5 V/3.3 V Operation
3.3 V/5 V Operation
83
40
130
66
mA
mA
75 MHz logic signal frequency
75 MHz logic signal frequency
V DD2 Supply Current
I DD2 (150)
5 V/3.3 V Operation
3.3 V/5 V Operation
40
83
66
130
mA
mA
75 MHz logic signal frequency
75 MHz logic signal frequency
For All Models
Input Currents
I IA , I IB , I IC ,
I ID , I E1 , I E2
?10
+0.01
+10
μA
0 ≤ V IA ,V IB , V IC ,V ID ≤ V DD1 or V DD2 ,
0 ≤ V E1 ,V E2 ≤ V DD1 or V DD2
Logic High Input Threshold
V IH , V EH
5 V/3.3 V Operation
3.3 V/5 V Operation
Logic Low Input Threshold
5 V/3.3 V Operation
3.3 V/5 V Operation
V IL , V EL
2.0
1.6
0.8
0.4
V
V
V
V
Logic High Output Voltages
V OAH , V OBH ,
V OCH , V ODH
(V DD1 or
V DD2 ) ? 0.1
(V DD1 or
V DD2 ) ? 0.4
(V DD1 or
V DD2 )
(V DD1 or
V DD2 ) ? 0.2
V
V
I Ox = ?20 μA, V Ix = V IxH
I Ox = ?4 mA, V Ix = V IxH
Logic Low Output Voltages
V OAL , V OBL ,
V OCL , V ODL
0.0
0.04
0.2
0.1
0.1
0.4
V
V
V
I Ox = 20 μA, V Ix = V IxL
I Ox = 400 μA, V Ix = V IxL
I Ox = 4 mA, V Ix = V IxL
SWITCHING SPECIFICATIONS
Minimum Pulse Width 2
Maximum Data Rate 3
PW
150
6.67
ns
Mbps
C L = 15 pF, CMOS signal levels
C L = 15 pF, CMOS signal levels
Propagation Delay 4
Pulse Width Distortion, |t PLH ? t PHL | 4
Change vs. Temperature
Propagation Delay Skew 5
Channel-to-Channel Matching,
Codirectional Channels 6
Channel-to-Channel Matching,
Opposing Directional Channels 5
t PHL , t PLH
PWD
t PSK
t PSKCD
t PSKOD
20
0.5
3
35
2
15
2
5
ns
ns
ps/°C
ns
ns
ns
C L = 15 pF, CMOS signal levels
C L = 15 pF, CMOS signal levels
C L = 15 pF, CMOS signal levels
C L = 15 pF, CMOS signal levels
C L = 15 pF, CMOS signal levels
C L = 15 pF, CMOS signal levels
For All Models
Output Disable Propagation Delay
(High/Low to High Impedance)
Output Enable Propagation Delay
(High Impedance to High/Low)
t PHZ , t PLH
t PZH , t PZL
6
6
8
8
ns
ns
C L = 15 pF, CMOS signal levels
C L = 15 pF, CMOS signal levels
Output Rise/Fall Time (10% to 90%)
5 V/3 V Operation
3 V/5 V Operation
t R /t F
3.0
2.5
ns
ns
C L = 15 pF, CMOS signal levels
Common-Mode Transient Immunity
at Logic High Output 7
Common-Mode Transient Immunity
at Logic Low Output 7
|CM H |
|CM L |
25
25
35
35
kV/μs
kV/μs
V Ix = V DD1 or V DD2 , V CM = 1000 V,
transient magnitude = 800 V
V Ix = 0 V, V CM = 1000 V,
transient magnitude = 800 V
Refresh Rate
f r
5 V/3.3 V Operation
3.3 V/5 V Operation
Input Dynamic Supply Current per Channel 8
5 V/3.3 V Operation
3.3 V/5 V Operation
Output Dynamic Supply Current per Channel 8
5 V/3.3 V Operation
3.3 V/5 V Operation
I DDI (D)
I DDO (D)
1.2
1.1
0.196
0.076
0.028
0.01
Rev. D | Page 8 of 24
Mbps
Mbps
mA/Mbps
mA/Mbps
mA/Mbps
mA/Mbps
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PDF描述 |
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参数描述 |
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