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参数资料
| 型号： | ADUM4400ARWZ |
| 厂商： | Analog Devices Inc |
| 文件页数： | 5/20页 |
| 文件大小： | 0K |
| 描述： | IC DIGITAL ISOLATOR 4CH 16-SOIC |
| 其它图纸： | ADUM4400 Series Diagram |
| 标准包装： | 47 |
| 系列： | iCoupler® |
| 输入 - 1 侧/2 侧： | 4/0 |
| 通道数： | 4 |
| 电源电压： | 2.7 V ~ 5.5 V |
| 电压 - 隔离： | 5000Vrms |
| 数据速率： | 1Mbps |
| 传输延迟： | 65ns |
| 输出类型： | 逻辑 |
| 封装/外壳： | 16-SOIC（0.295"，7.50mm 宽） |
| 供应商设备封装： | 16-SOIC W |
| 包装： | 管件 |
| 工作温度： | -40°C ~ 105°C |
| 产品目录页面： | 2766 (CN2011-ZH PDF) |
Data Sheet
ADuM4400/ADuM4401/ADuM4402
ELECTRICAL CHARACTERISTICS—MIXED 5 V/3 V OPERATION
All typical specifications are at T A = 25°C, V DD1 = 5 V, V DD2 = 3.0 V. Minimum/maximum specifications apply over the entire recommended
operation range: 4.5 V ≤ V DD1 ≤ 5.5 V, 2.7 V ≤ V DD2 ≤ 3.6 V, and ?40°C ≤ T A ≤ 105°C, unless otherwise noted. Switching specifications are
tested with C L = 15 pF and CMOS signal levels, unless otherwise noted.
Table 7.
A Grade
B Grade
C Grade
Parameter
Symbol
Min
Typ Max
Min
Typ Max
Min
Typ Max
Unit
Test Conditions
SWITCHING SPECIFICATIONS
Data Rate
1
10
90
Mbps
Within PWD limit
Propagation Delay
t PHL , t PLH
50
70
50
15
35
50
20
30
40
ns
50% input to 50% output
Pulse Width Distortion
PWD
40
3
0.5
2
ns
|t PLH ? t PHL |
Change vs. Temperature
11
5
3
ps/°C
Pulse Width
Propagation Delay Skew
PW
t PSK
1000
50
100
22
11.1
14
ns
ns
Within PWD limit
Between any two units
Channel Matching
Codirectional
Opposing-Direction
t PSKCD
t PSKOD
50
50
3
6
2
5
ns
ns
Table 8.
1 Mbps—A, B, C Grades
10 Mbps—B, C Grades
90 Mbps—C Grade
Parameter
Symbol
Min Typ Max
Min Typ Max
Min Typ Max
Unit
Test Conditions
SUPPLY CURRENT
ADuM4400
ADuM4401
ADuM4402
I DD1
I DD2
I DD1
I DD2
I DD1
I DD2
2.9
0.7
2.5
0.9
2.0
1.2
3.5
1.2
3.2
1.5
2.8
1.7
9.0
1.8
7.4
2.5
6.0
3.3
11.6
2.3
10.6
3.3
7.5
4.4
72
11
59
17
46
24
100
15
82
24
62
39
mA
mA
mA
mA
mA
mA
Table 9. For All Models
Parameter
Symbol
Min
Typ
Max
Unit
Test Conditions
DC SPECIFICATIONS
Logic High Input Threshold
Logic Low Input Threshold
V IH
V IL
2.0
0.8
V
V
Logic High Output Voltage
V OH
V DDx ? 0.1
V DDx ? 0.4
3.0
2.8
V
V
I Ox = ?20 μA, V Ix = V IxH
I Ox = ?4 mA, V Ix = V IxH
Logic Low Output Voltage
V OL
0.0
0.04
0.2
0.1
0.1
0.4
V
V
V
I Ox = 20 μA, V Ix = V IxL
I Ox = 400 μA, V Ix = V IxL
I Ox = 4 mA, V Ix = V IxL
Input Current per Channel
I I
?10
+0.01
+10
μA
0 V ≤ V Ix ≤ V DDx
Supply Current per Channel
Quiescent Input Supply Current
Quiescent Output Supply Current
Dynamic Input Supply Current
Dynamic Output Supply Current
I DDI(Q)
I DDO(Q)
I DDI(D)
I DDO(D)
0.57
0.29
0.20
0.03
0.83
0.27
mA
mA
mA/Mbps
mA/Mbps
AC SPECIFICATIONS
Output Rise/Fall Time
t R /t F
3
ns
10% to 90%
Common-Mode Transient Immunity 1
|CM|
25
35
kV/μs
V Ix = V DDx , V CM = 1000 V,
transient magnitude = 800 V
Output Disable Propagation Delay
Output Enable Propagation Delay
Refresh Rate
t PHZ , t PLH
t PZH , t PZL
f r
6
6
1.2
8
8
ns
ns
Mbps
High/low-to-high impedance
High impedance-to-high/low
1
|CM| is the maximum common-mode voltage slew rate that can be sustained while maintaining V O > 0.8 V DD . The common-mode voltage slew rates apply to both
rising and falling common-mode voltage edges.
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PDF描述 |
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参数描述 |
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