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参数资料
| 型号： | ADZS-BF609-EZLITE |
| 厂商： | Analog Devices Inc |
| 文件页数： | 32/98页 |
| 文件大小： | 0K |
| 描述： | KIT EZ FOR BLACKFIN BF60X FAMILY |
| 标准包装： | 1 |
| 系列： | Blackfin® |
| 类型： | DSP |
| 适用于相关产品： | ADSP-BF60x |
| 所含物品： | 板，电缆，电源，单机调试代理 |
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DDR2 SDRAM
THE BOARD HAS A 16M X 16-BIT BURST FLASH MEMORY CONNECTED TO THE PRO-
CESSOR’S STATIC MEMORY CONTROLLER (SMC). THE PROCESSOR ALSO IS CONNECTED
TO A 32 MB QUAD SERIAL FLASH MEMORY VIA THE SERIAL PERIPHERAL INTERFACE
(SPI). BOTH FLASH MEMORIES CAN BE USED FOR NON-VOLATILE DATA STORAGE AND
PROCESSOR BOOT.
DDR2 SDRAM
THE ADSP-BF609 PROCESSOR CONNECTS TO A 128 MB MICRON
MT47H64M16HR-3 CHIP THROUGH THE DOUBLE DATA RATE SYNCHRONOUS
DYNAMIC RANDOM-ACCESS MEMORY (DDR2 SDRAM) CONTROLLER. THE
DDR2 MEMORY CONTROLLER ON THE PROCESSOR AND DDR2 MEMORY CHIP ARE
POWERED BY THE ON-BOARD 1.8V REGULATOR. DATA IS TRANSFERRED BETWEEN THE
PROCESSOR AND DDR2 ON BOTH THE RISING AND FALLING EDGES OF THE DDR2
CLOCK. THE DDR2 CONTROLLER ON THE PROCESSOR CAN OPERATE AT A MAXIMUM
CLOCK FREQUENCY OF 250 MHZ.
WITH A CCES SESSION RUNNING AND CONNECTED TO THE EZ-KIT LITE VIA THE
USB STANDALONE DEBUG AGENT, THE DDR2 REGISTERS ARE CONFIGURED AUTOMAT-
ICALLY EACH TIME THE PROCESSOR IS RESET. THE VALUES ARE USED WHENEVER
DDR2 IS ACCESSED THROUGH THE DEBUGGER (FOR EXAMPLE, WHEN VIEWING
MEMORY OR LOADING A PROGRAM).
TO DISABLE THE AUTOMATIC SETTING OF THE DDR2 REGISTERS, SELECT Target
Options FROM THE Session MENU IN CCES AND UNCHECK Use XML reset
values .
AN EXAMPLE PROGRAM IS INCLUDED IN THE EZ-KIT LITE INSTALLATION DIRECTORY
TO DEMONSTRATE HOW TO SETUP AND ACCESS THE DDR2 INTERFACE. FOR MORE
INFORMATION ON HOW TO INITIALIZE THE REGISTERS AFTER A RESET, REFER TO THE
HARDWARE REFERENCE MANUAL.
1-12
ADSP-BF609 EZ-KIT LITE EVALUATION SYSTEM MANUAL
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