参数资料
| 型号： | AGLN250V5-ZVQ100 |
| 厂商： | Microsemi SoC |
| 文件页数： | 91/150页 |
| 文件大小： | 0K |
| 描述： | IC FPGA NANO 1KB 250K 100VQFP |
| 标准包装： | 90 |
| 系列： | IGLOO nano |
| 逻辑元件/单元数： | 6144 |
| RAM 位总计： | 36864 |
| 输入/输出数： | 68 |
| 门数： | 250000 |
| 电源电压： | 1.425 V ~ 1.575 V |
| 安装类型： | 表面贴装 |
| 工作温度： | -20°C ~ 70°C |
| 封装/外壳： | 100-TQFP |
| 供应商设备封装： | 100-VQFP（14x14） |
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IGLOO nano Low Power Flash FPGAs
Revision 17
2-29
3.3 V LVCMOS Wide Range
Table 2-40 Minimum and Maximum DC Input and Output Levels for LVCMOS 3.3 V Wide Range
3.3 V LVCMOS
Wide Range1
Equivalent
Software
Default
Drive
Strength
Option4
VIL
VIH
VOL
VOH
IOL
IOH IIL 2 IIH 3
Drive
Strength
Min.
V
Max.
V
Min.
V
Max.
V
Max.
V
Min.
VA
A
A5
100 A
2 mA
–0.3
0.8
2
3.6
0.2
VCCI – 0.2 100
100
10
100 A
4 mA
–0.3
0.8
2
3.6
0.2
VCCI – 0.2 100
100
10
100 A
6 mA
–0.3
0.8
2
3.6
0.2
VCCI – 0.2 100
100
10
100 A
8mA
–0.3
0.8
2
3.6
0.2
VCCI – 0.2 100
100
10
Notes:
1. All LVCMOS 3.3 V software macros support LVCMOS 3.3 V Wide Range, as specified in the JEDEC JESD8-B
specification.
2. IIL is the input leakage current per I/O pin over recommended operating conditions where –0.3 < VIN < VIL.
3. IIH is the input leakage current per I/O pin over recommended operating conditions where VIH < VIN < VCCI. Input
current is larger when operating outside recommended ranges.
4. The minimum drive strength for any LVCMOS 3.3 V software configuration when run in wide range is ±100 A. Drive
strength displayed in the software is supported for normal range only. For a detailed I/V curve, refer to the IBIS models.
5. Currents are measured at 85°C junction temperature.
6. Software default selection is highlighted in gray.
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PDF描述 |
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