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参数资料
| 型号： | AK4665AEN |
| 元件分类： | 消费家电 |
| 英文描述： | SPECIALTY CONSUMER CIRCUIT, QCC32 |
| 封装： | 5 X 5 MM, 0.50 MM PITCH, LEAD FREE, QFN-32 |
| 文件页数： | 2/52页 |
| 文件大小： | 522K |
| 代理商： | AK4665AEN |
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ASAHI KASEI
[AK4665A]
MS0440-E-01
2006/05
- 10 -
SWITCHING CHARACTERISTICS
(Ta=25
°C; AVDD, DVDD, HVDD = 2.6 3.6V; TVDD=1.6 3.6V; CL = 20pF)
Parameter
Symbol
min
typ
max
Units
Master Clock Timing
Frequency
fCLK
2.048
-
24.576
MHz
Pulse Width Low
tCLKL
0.4/fCLK
-
ns
Pulse Width High
tCLKH
0.4/fCLK
-
ns
LRCK Timing
Frequency
fs
8
44.1
48
kHz
Duty Cycle
Duty
45
55
%
Serial Interface Timing (Note 18)
BICK Period
tBCK
325.5
-
ns
BICK Pulse Width Low
tBCKL
130
-
ns
Pulse Width High
tBCKH
130
-
ns
LRCK Edge to BICK “
↑” (Note 19)
tLRB
50
-
ns
BICK “
↑” to LRCK Edge (Note 19)
tBLR
50
-
ns
LRCK to SDTO(MSB)
tLRS
-
80
ns
BICK “
↓” to SDTO
tBSD
-
80
ns
SDTI Hold Time
tSDH
50
-
ns
SDTI Setup Time
tSDS
50
-
ns
Control Interface Timing
CCLK Period
tCCK
200
-
ns
CCLK Pulse Width Low
tCCKL
80
-
ns
Pulse Width High
tCCKH
80
-
ns
CDTI Setup Time
tCDS
40
-
ns
CDTI Hold Time
tCDH
40
-
ns
CSN “H” Time
tCSW
150
-
ns
CSN “
↓” to CCLK “↑”
tCSS
50
-
ns
CCLK “
↑” to CSN “↑”
tCSH
50
-
ns
Power-down & Reset Timing
PDN Pulse Width (Note 20)
tPD
150
-
ns
PMADC “
↑” to SDTO valid (Note 21)
tPDV
-
2081
-
1/fs
Note 18. Refer to “Serial Data Interface”.
Note 19. BICK rising edge must not occur at the same time as LRCK edge.
Note 20. The AK4665A can be reset by bringing PDN= “L” to “H” only upon power up.
Note 21. This is the count of LRCK “
↑” from PMADC bit=”1”.
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PDF描述 |
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