参数资料
| 型号： | APA1000-LG624B |
| 厂商： | Microsemi SoC |
| 文件页数： | 132/178页 |
| 文件大小： | 0K |
| 描述： | IC FPGA PROASIC+ 1M 624-LGA |
| 标准包装： | 1 |
| 系列： | ProASICPLUS |
| RAM 位总计： | 202752 |
| 输入/输出数： | 440 |
| 门数： | 1000000 |
| 电源电压： | 2.3 V ~ 2.7 V |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 624-BCLGA |
| 供应商设备封装： | 624-CLGA（32.5x32.5） |
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ProASICPLUS Flash Family FPGAs
v5.9
2-47
Table 2-37 Worst-Case Military Conditions
VDDP = 3.0V, VDD = 2.3V, TJ = 125°C for Military/MIL-STD-883
Macro Type
Description
Max. tINYH
1
Max. tINYL
2
Units
Std.
IB33
3.3 V, CMOS Input Levels3, No Pull-up Resistor
0.5
0.6
ns
IB33S
3.3 V, CMOS Input Levels3, No Pull-up Resistor, Schmitt Trigger
0.6
0.8
ns
Notes:
1. tINYH = Input Pad-to-Y High
2. tINYL = Input Pad-to-Y Low
3. LVTTL delays are the same as CMOS delays.
4. For LP Macros, VDDP =2.3 V for delays.
Table 2-38 Worst-Case Military Conditions
VDDP = 2.3V, VDD = 2.3V, TJ = 125°C for Military/MIL-STD-883
Macro Type
Description
Max. tINYH
1
Max. tINYL
2
Units
Std.
IB25LP
2.5 V, CMOS Input Levels3, Low Power
0.9
0.7
ns
IB25LPS
2.5 V, CMOS Input Levels3, Low Power, Schmitt Trigger
0.8
1.0
ns
Notes:
1. tINYH = Input Pad-to-Y High
2. tINYL = Input Pad-to-Y Low
3. LVTTL delays are the same as CMOS delays.
4. For LP Macros, VDDP =2.3 V for delays.
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