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参数资料
| 型号： | APA600-BG456B |
| 元件分类： | FPGA |
| 英文描述： | FPGA, 600000 GATES, PBGA456 |
| 封装： | 1.27 MM PITCH, PLASTIC, BGA-456 |
| 文件页数： | 114/170页 |
| 文件大小： | 1387K |
| 代理商： | APA600-BG456B |
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ProASICPLUS Flash Family FPGAs
1- 44
v4.1
Table 1-29 Worst-Case Commercial Conditions
VDDP = 3.0V, VDD = 2.3V, 35 pF load, TJ = 125°C for Military/Mil-Std 883B
Macro Type
Description
Max.
tDLH
1
Max.
tDHL
2
Units
Std.
OB33PH
3.3V, PCI Output Current, High Slew Rate
2.1
2.3
ns
OB33PN
3.3V, High Output Current, Nominal Slew Rate
2.5
3.2
ns
OB33PL
3.3V, High Output Current, Low Slew Rate
2.7
3.5
ns
OB33LH
3.3V, Low Output Current, High Slew Rate
2.7
4.3
ns
OB33LN
3.3V, Low Output Current, Nominal Slew Rate
3.3
4.7
ns
OB33LL
3.3V, Low Output Current, Low Slew Rate
3.3
6.1
ns
OB25LPHH
2.5V, Low Power, High Output Current, High Slew Rate3
2.3
2.4
ns
OB25LPHN
2.5V, Low Power, High Output Current, Nominal Slew Rate3
2.7
3.3
ns
OB25LPHL
2.5V, Low Power, High Output Current, Low Slew Rate3
3.2
3.5
ns
OB25LPLH
2.5V, Low Power, Low Output Current, High Slew Rate3
3.0
5.0
ns
OB25LPLN
2.5V, Low Power, Low Output Current, Nominal Slew Rate3
3.9
4.6
ns
OB25LPLL
2.5V, Low Power, Low Output Current, Low Slew Rate3
4.3
5.7
ns
Notes:
1. tDLH = Data-to-Pad High
2. tDHL = Data-to-Pad Low
3. Low power I/O work with VDDP=2.5V ±10% only. VDDP=2.3V for delays.
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PDF描述 |
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