参数资料
型号: AQ83C154DXXX-20D
厂商: TEMIC SEMICONDUCTORS
元件分类: 微控制器/微处理器
英文描述: 8-BIT, MROM, 20 MHz, MICROCONTROLLER, CQFP44
文件页数: 55/242页
文件大小: 3080K
代理商: AQ83C154DXXX-20D
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2588F–AVR–06/2013
ATtiny261/461/861
Figure 15-7. ADC Timing Diagram, Free Running Conversion
For a summary of conversion times, see Table 15-1.
15.6
Changing Channel or Reference Selection
The MUX5:0 and REFS2:0 bits in the ADCSRB and ADMUX registers are single buffered
through a temporary register to which the CPU has random access. This ensures that the chan-
nels and reference selection only takes place at a safe point during the conversion. The channel
and reference selection is continuously updated until a conversion is started. Once the conver-
sion starts, the channel and reference selection is locked to ensure a sufficient sampling time for
the ADC. Continuous updating resumes in the last ADC clock cycle before the conversion com-
pletes (ADIF in ADCSRA is set). Note that the conversion starts on the following rising ADC
clock edge after ADSC is written. The user is thus advised not to write new channel or reference
selection values to ADMUX until one ADC clock cycle after ADSC is written.
If Auto Triggering is used, the exact time of the triggering event can be indeterministic. Special
care must be taken when updating the ADMUX Register, in order to control which conversion
will be affected by the new settings.
If both ADATE and ADEN is written to one, an interrupt event can occur at any time. If the
ADMUX Register is changed in this period, the user cannot tell if the next conversion is based
on the old or the new settings.
ADMUX can be safely updated in the following ways:
Table 15-1.
ADC Conversion Time
Condition
Sample & Hold
(Cycles from Start of Conversion)
Total Conversion Time (Cycles)
First conversion
13.5
25
Normal conversions
1.5
13
Auto Triggered conversions
2
13.5
11
12
13
Sign and MSB of Result
LSB of Result
ADC Clock
ADSC
ADIF
ADCH
ADCL
Cycle Number
12
One Conversion
Next Conversion
34
Conversion
Complete
Sample & Hold
MUX and REFS
Update
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