参数资料
型号: AS5030-ATST
厂商: ams
文件页数: 10/44页
文件大小: 0K
描述: IC ENCODER ROTARY 8-BIT 16-TSSOP
应用说明: AS5000 Series Magnet Selection Guide
AS5000 Series Magnets for Extended Vertical Range
标准包装: 1
传感范围: 23.6mT ~ 44.5mT
类型: 线性,旋转编码器 - 可编程
电源电压: 4.5 V ~ 5.5 V
电流 - 电源: 14mA
电流 - 输出(最大): 4mA
输出类型: 数字,PWM
特点: 可编程
工作温度: -40°C ~ 125°C
封装/外壳: 16-TSSOP(0.173",4.40mm 宽)
供应商设备封装: 16-TSSOP
包装: 标准包装
产品目录页面: 804 (CN2011-ZH PDF)
其它名称: AS5030-ATSTDKR
AS5030
Datasheet - E l e c t r i c a l C h a r a c t e r i s t i c s
6.10 General Data Transmission Timings
Symbol
t0
Parameter
Rising CLK to CS
Conditions
Min
CLK/2
+0
Typ
Max
CLK/2
+50
Units
ns
t1
t2
t3
t4
t5
t6
Chip select to positive edge of CLK
Chip select to drive bus externally
Setup time command bit data valid to
positive edge of CLK
Hold time command bit data valid after
positive edge of CLK
Float time positive edge of CLK for last
command bit to bus float
Bus driving time positive edge of CLK for
last command bit to bus drive
50
0
50
15
CLK/2
+0
CLK/2 +0
ns
ns
ns
ns
ns
ns
t7
Setup time data bit data valid to positive
edge of CLK
CLK/2
+0
CLK/2
+30
ns
t8
t9
t10
t11
t12
t13
Hold time data bit data valid after positive
edge of CLK
Hold time chip select positive edge CLK to
negative edge of chip select
Bus floating time negative edge of chip
select to float bus
Hold time data bit @ write access
data valid to positive edge of CLK
Hold time data bit @ write access
data valid after positive edge of CLK
Bus floating time negative edge of chip
select to float bus
CLK/2
+0
CLK/2
+50
50
15
50
50
ns
ns
ns
ns
ns
ns
t TO
Timeout period in 2-wire mode
(from rising edge of CLK)
20
24
μs
See Figure 5 for the corresponding timing diagram.
www.ams.com/AS5030
Revision 2.4
10 - 44
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