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参数资料
| 型号： | AS7C31024B-20TJC |
| 厂商： | ALLIANCE SEMICONDUCTOR CORP |
| 元件分类： | DRAM |
| 英文描述： | 128 x 64 pixel format, LED or EL Backlight available |
| 中文描述： | 128K X 8 STANDARD SRAM, 20 ns, PDSO32 |
| 封装： | 0.300 INCH, PLASTIC, SOJ-32 |
| 文件页数： | 4/9页 |
| 文件大小： | 120K |
| 代理商： | AS7C31024B-20TJC |
AS7C31024B
3/24/04, v.1.2
Alliance Semiconductor
P. 4 of 9
Key to switching waveforms
Read waveform 1 (address controlled)
3,6,7,9,12
Read waveform 2 (CE1, CE2, and OE controlled)
3,6,8,9,12
Read cycle (over the operating range)
3,9,12
Parameter
Symbol
t
RC
t
AA
t
ACE1
t
ACE2
t
OE
t
OH
t
CLZ1
t
CLZ2
t
CHZ1
t
CHZ2
t
OLZ
t
OHZ
t
PU
t
PD
-10
-12
-15
-20
Unit
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
Notes
Min
10
–
–
–
–
3
3
3
–
–
0
–
0
–
Max
–
10
10
10
5
–
–
–
3
3
–
5
–
10
Min
12
–
–
–
–
3
3
3
–
–
0
–
0
–
Max
–
12
12
12
6
–
–
–
3
3
–
6
–
12
Min
15
–
–
–
–
3
3
3
–
–
0
–
0
–
Max
–
15
15
15
7
–
–
–
4
4
–
7
–
15
Min
20
–
–
–
–
3
3
3
–
–
0
–
0
–
Max
Read cycle time
Address access time
Chip enable (CE1) access time
Chip enable (CE2) access time
Output enable (OE) access time
Output hold from address change
CE1 low to output in low Z
CE2 high to output in low Z
CE1 high to output in high Z
CE2 low to output in high Z
OE low to output in low Z
OE high to output in high Z
Power up time
Power down time
20
20
20
8
–
–
–
5
5
–
8
–
20
3
3, 12
3, 12
5
4, 5, 12
4, 5, 12
4, 5, 12
4, 5, 12
4, 5
4, 5
4, 5, 12
4, 5, 12
Undefined / don’t care
Falling input
Rising input
Address
D
OUT
Data valid
t
OH
t
AA
t
RC
Supply
current
CE2
OE
D
OUT
t
OE
t
OLZ
t
ACE1
,
tACE2
t
CHZ1
, t
CHZ2
t
CLZ1
, t
CLZ2
t
PU
t
PD
I
CC
I
SB
50%
50%
Data valid
t
RC1
CE1
t
OHZ
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PDF描述 |
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