参数资料
| 型号： | AT24C256C-XHL-T |
| 厂商： | Atmel |
| 文件页数： | 9/21页 |
| 文件大小： | 0K |
| 描述： | IC EEPROM 256KBIT IND 8TSSOP |
| 标准包装： | 1 |
| 格式 - 存储器： | EEPROMs - 串行 |
| 存储器类型： | EEPROM |
| 存储容量： | 256K (32K x 8) |
| 速度： | 400kHz，1MHz |
| 接口： | I²C，2 线串口 |
| 电源电压： | 1.7 V ~ 5.5 V |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 8-TSSOP（0.173"，4.40mm 宽） |
| 供应商设备封装： | 8-TSSOP |
| 包装： | 剪切带 (CT) |
| 其它名称： | AT24C256C-XHL-TCT |
7.
Device Addressing
The 256K EEPROM requires an 8-bit device address word following a start condition to enable the chip for a read or
write operation ( Figure 7-1 ). The device address word consists of a mandatory one, zero sequence for the first four most
significant bits as shown. This is common to all 2-wire EEPROM devices.
Figure 7-1. Device Addressing
1
0
1
0
A2
A1
A0
R/W
MSB
LSB
The next three bits are the A2, A1, and A0 device address bits to allow as many as eight devices on the same bus. These
bits must compare to their corresponding hard wired input pins. The A 2 , A 1 , and A 0 pins use an internal proprietary circuit
that biases them to a logic low condition if the pins are allowed to float.
The eighth bit of the device address is the read/write operation select bit. A read operation is initiated if this bit is high,
and a write operation is initiated if this bit is low.
Upon a compare of the device address, the EEPROM will output a zero. If a compare is not made, the device will return
to a standby state.
Data Security: AT24C256C has a hardware data protection scheme that allows the user to write protect the whole
memory when the WP pin is at V CC .
Atmel AT24C256C [DATASHEET]
8568E–SEEPR–8/2012
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PDF描述 |
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参数描述 |
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| AT24C256N-10SI | 功能描述:IC EEPROM 256KBIT 1MHZ 8SOIC RoHS:否 类别:集成电路 (IC) >> 存储器 系列:- 标准包装:32 系列:- 格式 - 存储器:闪存 存储器类型:FLASH 存储容量:1M (128K x 8) 速度:120ns 接口:并联 电源电压:2.7 V ~ 3.6 V 工作温度:0°C ~ 70°C 封装/外壳:32-LCC（J 形引线） 供应商设备封装:32-PLCC 包装:管件 其它名称:AT49BV00112JC |
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