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参数资料
| 型号： | AT28LV256-20TC |
| 厂商： | ATMEL CORP |
| 元件分类： | DRAM |
| 英文描述： | High Speed CMOS Logic Dual Retriggerable Precision Monostable Multivibrators 16-TSSOP -55 to 125 |
| 中文描述： | 32K X 8 EEPROM 3V, 200 ns, PDSO28 |
| 封装： | PLASTIC, TSOP-28 |
| 文件页数： | 7/10页 |
| 文件大小： | 602K |
| 代理商： | AT28LV256-20TC |
Symbol
Parameter
Min
Max
Units
t
WC
t
AS
t
AH
t
DS
t
DH
t
WP
t
BLC
t
WPH
Write Cycle Time
10
ms
Address Set-up Time
0
ns
Address Hold Time
50
ns
Data Set-up Time
50
ns
Data Hold Time
0
ns
Write Pulse Width
200
ns
μ
s
ns
Byte Load Cycle Time
150
Write Pulse Width High
100
Page Mode Characteristics
Software Protected Write Cycle Waveforms
(1, 2, 3)
Notes: 1. A0 - A14 must conform to the addressing sequence for
the first three bytes as shown above.
2. A6 through A14 must specify the same page address during
each high to low transition of WE (or CE) after the software
code has been entered.
3. OE must be high only when WE and CE are both low.
LOAD LAST BYTE
TO
LAST ADDRESS
(3)
LOAD DATA A0
TO
ADDRESS 5555
LOAD DATA 55
TO
ADDRESS 2AAA
LOAD DATA AA
TO
ADDRESS 5555
Notes:
1. Data Format: I/O7 - I/O0 (Hex);
Address Format: A14 - A0 (Hex).
2. Data protect state will be re-activated at the end of program
cycle.
3. 1 to 64-bytes of data are loaded.
ENTER DATA
PROTECT STATE
WRITES ENABLED
(2)
Programming Algorithm
LOAD DATA XX
TO
ANY ADDRESS
(3)
AT28LV256
2-151
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PDF描述 |
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