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参数资料
| 型号： | AT32UC3C0512C-ALUT |
| 厂商： | Atmel |
| 文件页数： | 36/110页 |
| 文件大小： | 0K |
| 描述： | IC MCU AVR32 512K FLASH 144LQFP |
| 产品培训模块： | AVR® UC3 Introduction |
| 标准包装： | 300 |
| 系列： | AVR®32 UC3 C |
| 核心处理器： | AVR |
| 芯体尺寸： | 32-位 |
| 速度： | 66MHz |
| 连通性： | CAN，EBI/EMI，以太网，I²C，IrDA，LIN，SPI，UART/USART，USB |
| 外围设备： | 欠压检测/复位，DMA，I²S，POR，PWM，WDT |
| 输入/输出数： | 123 |
| 程序存储器容量： | 512KB（512K x 8） |
| 程序存储器类型： | 闪存 |
| RAM 容量： | 64K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 3 V ~ 5.5 V |
| 数据转换器： | A/D 16x12b，D/A 4x12b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 144-LQFP |
| 包装： | 托盘 |
| 配用： | ATSTK600-SC19-ND - STK600 LQFP SOCKET CARD AVR ATSTK600-RC36-ND - STK600 ROUTING CARD AVR |
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31
32117DS–AVR-01/12
AT32UC3C
Figure 4-5.
The Status Register Low Halfword
4.4.3
Processor States
4.4.3.1
Normal RISC State
The AVR32 processor supports several different execution contexts as shown in Table 4-2.
Mode changes can be made under software control, or can be caused by external interrupts or
exception processing. A mode can be interrupted by a higher priority mode, but never by one
with lower priority. Nested exceptions can be supported with a minimal software overhead.
When running an operating system on the AVR32, user processes will typically execute in the
application mode. The programs executed in this mode are restricted from executing certain
instructions. Furthermore, most system registers together with the upper halfword of the status
register cannot be accessed. Protected memory areas are also not available. All other operating
modes are privileged and are collectively called System Modes. They have full access to all priv-
ileged and unprivileged resources. After a reset, the processor will be in supervisor mode.
4.4.3.2
Debug State
The AVR32 can be set in a debug state, which allows implementation of software monitor rou-
tines that can read out and alter system information for use during application development. This
implies that all system and application registers, including the status registers and program
counters, are accessible in debug state. The privileged instructions are also available.
All interrupt levels are by default disabled when debug state is entered, but they can individually
be switched on by the monitor routine by clearing the respective mask bit in the status register.
Bit 15
Bit 0
Reserved
Carry
Zero
Sign
0
-
T
-
Bit name
Initial value
0
L
Q
V
N
Z
C
-
Overflow
Saturation
-
Lock
Reserved
Scratch
Table 4-2.
Overview of Execution Modes, their Priorities and Privilege Levels.
Priority
Mode
Security
Description
1
Non Maskable Interrupt
Privileged
Non Maskable high priority interrupt mode
2
Exception
Privileged
Execute exceptions
3
Interrupt 3
Privileged
General purpose interrupt mode
4
Interrupt 2
Privileged
General purpose interrupt mode
5
Interrupt 1
Privileged
General purpose interrupt mode
6
Interrupt 0
Privileged
General purpose interrupt mode
N/A
Supervisor
Privileged
Runs supervisor calls
N/A
Application
Unprivileged
Normal program execution mode
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参数描述 |
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