参数资料
| 型号： | AT32UC3C2256C-A2UT |
| 厂商： | Atmel |
| 文件页数： | 3/110页 |
| 文件大小： | 0K |
| 描述： | IC MCU AVR32 256K FLASH 64TQFP |
| 产品培训模块： | AVR® UC3 Introduction |
| 标准包装： | 800 |
| 系列： | AVR®32 UC3 C |
| 核心处理器： | AVR |
| 芯体尺寸： | 32-位 |
| 速度： | 66MHz |
| 连通性： | CAN，以太网，I²C，IrDA，LIN，SPI，UART/USART，USB |
| 外围设备： | 欠压检测/复位，DMA，I²S，POR，PWM，WDT |
| 输入/输出数： | 45 |
| 程序存储器容量： | 256KB（256K x 8） |
| 程序存储器类型： | 闪存 |
| RAM 容量： | 64K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 3 V ~ 5.5 V |
| 数据转换器： | A/D 11x12b，D/A 2x12b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 64-TQFP |
| 包装： | 托盘 |
| 配用： | ATSTK600-SC14-ND - STK600 TQFP SOCKET CARD AVR ATSTK600-RC40-ND - STK600 ROUTING CARD AVR |
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100
32117DS–AVR-01/12
AT32UC3C
Fix/Workaround
None.
3
In host mode, the disconnection during OUT transition is not supported
In USB host mode, a pipe can not work if the previous USB device disconnection has
occurred during a USB transfer.
Fix/Workaround
Reset the USBC (USBCON.USB=0 and =1) after a device disconnection (UHINT.DDISCI).
4
In USB host mode, entering suspend mode can fail
In USB host mode, entering suspend mode can fail when UHCON.SOFE=0 is done just
after a SOF reception (UHINT.HSOFI).
Fix/Workaround
Check that UHNUM.FLENHIGH is below 185 in Full speed and below 21 in Low speed
before clearing UHCON.SOFE.
5
In USB host mode, entering suspend mode for low speed device can fail when the
USB freeze (USBCON.FRZCLK=1) is done just after UHCON.SOFE=0.
Fix/Workaround
When entering suspend mode (UHCON.SOFE is cleared), check that USBFSM.DRDSTATE
is not equal to three before freezing the clock (USBCON.FRZCLK=1).
10.1.11
WDT
1
WDT Control Register does not have synchronization feedback
When writing to the Timeout Prescale Select (PSEL), Time Ban Prescale Select (TBAN),
Enable (EN), or WDT Mode (MODE) fieldss of the WDT Control Register (CTRL), a synchro-
nizer is started to propagate the values to the WDT clcok domain. This synchronization
takes a finite amount of time, but only the status of the synchronization of the EN bit is
reflected back to the user. Writing to the synchronized fields during synchronization can lead
to undefined behavior.
Fix/Workaround
-When writing to the affected fields, the user must ensure a wait corresponding to 2 clock
cycles of both the WDT peripheral bus clock and the selected WDT clock source.
-When doing writes that changes the EN bit, the EN bit can be read back until it reflects the
written value.
相关PDF资料 |
PDF描述 |
|---|---|
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| 35650-51 | BNC RES CAP/CHAIN 50 OHMS |
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相关代理商/技术参数 |
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