参数资料
| 型号： | AT32UC3C2512C-Z2ZT |
| 厂商： | Atmel |
| 文件页数： | 3/109页 |
| 文件大小： | 0K |
| 描述： | IC MCU 32BIT 512KB FLASH 64QFN |
| 标准包装： | 1,300 |
| 系列： | AVR®32 UC3 C |
| 核心处理器： | AVR |
| 芯体尺寸： | 32-位 |
| 速度： | 50MHz |
| 连通性： | CAN，以太网，I²C，IrDA，LIN，SPI，UART/USART，USB |
| 外围设备： | 欠压检测/复位，DMA，I²S，POR，PWM，WDT |
| 输入/输出数： | 45 |
| 程序存储器容量： | 512KB（512K x 8） |
| 程序存储器类型： | 闪存 |
| RAM 容量： | 64K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 3 V ~ 5.5 V |
| 数据转换器： | A/D 11x12b，D/A 2x12b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 125°C |
| 封装/外壳： | 64-VFQFN 裸露焊盘 |
| 包装： | 托盘 |
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100
9166DS–AVR-01/12
AT32UC3C
10.2
rev D
10.2.1
ADCIFA
1
ADCREFP/ADCREFN can not be selected as an external ADC reference by setting the
ADCIFA.CFG.EXREF bit to one
Fix/Workaround
A vo lt ag e r e f e r e n c e ca n b e a p p lie d on A D CREFP/ADC REFN pins if the
ADCIFA.CFG.EXREF bit is set to zero, the ADCIFA.CFG.RS bit is set to zero and the volt-
age reference applied on ADCREFP/ADCREFN pins is higher than the internal 1V
reference.
10.2.2
AST
1
AST wake signal is released one AST clock cycle after the BUSY bit is cleared
After writing to the Status Clear Register (SCR) the wake signal is released one AST clock
cycle after the BUSY bit in the Status Register (SR.BUSY) is cleared. If entering sleep mode
directly after the BUSY bit is cleared the part will wake up immediately.
Fix/Workaround
Read the Wake Enable Register (WER) and write this value back to the same register. Wait
for BUSY to clear before entering sleep mode.
10.2.3
aWire
1
aWire MEMORY_SPEED_REQUEST command does not return correct CV
The aWire MEMORY_SPEED_REQUEST command does not return a CV corresponding to
the formula in the aWire Debug Interface chapter.
Fix/Workaround
Issu e
a
d u m m y
r e a d
to
a d d r es s
0 x 10 00 00 00 0
be for e
issu in g
th e
MEMORY_SPEED_REQUEST command and use this formula instead:
10.2.4
GPIO
1
Clearing Interrupt flags can mask other interrupts
When clearing interrupt flags in a GPIO port, interrupts on other pins of that port, happening
in the same clock cycle will not be registered.
Fix/Workaround
Read the PVR register of the port before and after clearing the interrupt to see if any pin
change has happened while clearing the interrupt. If any change occurred in the PVR
between the reads, they must be treated as an interrupt.
10.2.5
Power Manager
1
Clock Failure Detector (CFD) can be issued while turning off the CFD
While turning off the CFD, the CFD bit in the Status Register (SR) can be set. This will
change the main clock source to RCSYS.
Fix/Workaround
Solution 1: Enable CFD interrupt. If CFD interrupt is issues after turning off the CFD, switch
back to original main clock source.
Solution 2: Only turn off the CFD while running the main clock on RCSYS.
fsab
7
faw
CV 3
–
-----------------
=
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