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参数资料
| 型号： | AT83SND1CXXX-7HTIL |
| 厂商： | ATMEL CORP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | Single-Chip Flash Microcontroller with MP3 Decoder and Guman Interface |
| 中文描述： | 8-BIT, MROM, 40 MHz, MICROCONTROLLER, PBGA81 |
| 封装： | MO-205, BGA-81 |
| 文件页数： | 13/216页 |
| 文件大小： | 2722K |
| 代理商： | AT83SND1CXXX-7HTIL |
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13
AT8xC51SND1C
4109H–8051–01/05
Figure 6.
Mode Switching Waveforms
Note:
1. In order to prevent any incorrect operation while operating in X2 mode, user must be
aware that all peripherals using clock frequency as time reference (timers, etc.) will
have their time reference divided by 2. For example, a free running timer generating
an interrupt every 20 ms will then generate an interrupt every 10 ms.
6.3 PLL
6.3.1 PLL Description
The AT8xC51SND1C PLL is used to generate internal high frequency clock (the PLL
Clock) synchronized with an external low-frequency (the Oscillator Clock). The PLL
clock provides the MP3 decoder, the audio interface, and the USB interface clocks.
Figure 7 shows the internal structure of the PLL.
The PFLD block is the Phase Frequency Comparator and Lock Detector. This block
makes the comparison between the reference clock coming from the N divider and the
reverse clock coming from the R divider and generates some pulses on the Up or Down
signal depending on the edge position of the reverse clock. The PLLEN bit in PLLCON
register is used to enable the clock generation. When the PLL is locked, the bit PLOCK
in PLLCON register (see Table 6) is set.
The CHP block is the Charge Pump that generates the voltage reference for the VCO by
injecting or extracting charges from the external filter connected on PFILT pin (see
Figure 8). Value of the filter components are detailed in the Section “DC
Characteristics”.
The VCO block is the Voltage Controlled Oscillator controlled by the voltage V
ref
pro-
duced by the charge pump. It generates a square wave signal: the PLL clock.
Figure 7.
PLL Block Diagram and Symbol
X1
÷
2
X1
Clock
X2 Bi
t
X2 Mode
(1)
STD Mode
STD Mode
PLLEN
PLLCON.1
N6:0
N divider
R divider
R9:0
VCO
PLLclk
OSCclk
R
1
+
(
1
)
×
+
N
=
OSC
CLOCK
PFLD
PLOCK
PLLCON.0
PFILT
CHP
Vref
Up
Down
PLL
CLOCK
PLL Clock Symbol
PLL
Clock
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