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参数资料
| 型号： | AT86RF401E |
| 厂商： | ATMEL CORP |
| 元件分类： | 通信及网络 |
| 英文描述： | Smart RF Wireless Data Microtransmitter |
| 中文描述： | SPECIALTY TELECOM CIRCUIT, PDSO20 |
| 封装： | 4.40 X 6.50 MM, 0.65 MM PITCH, TSSOP-20 |
| 文件页数： | 27/52页 |
| 文件大小： | 479K |
| 代理商： | AT86RF401E |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页当前第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页
27
AT86RF401
1424F
–
RKE
–
12/03
The internal data SRAM access is performed in two System Clock cycles as described
in Figure 24.
Figure 24.
On-chip Data SRAM Access Cycles
All I/Os and peripherals are placed in the I/O space. The I/O locations are accessed by
the IN and OUT instructions, transferring data between the 32 general-purpose working
registers and the I/O space. I/O registers within the address range $00
–
$1F are directly
bit-accessible using the SBI and CBI instructions. In these registers, the value of single
bits can be checked by using the SBIS and SBIC instructions. Refer to Table 10,
“
Instruction Set Manual,
”
on page 44 for more details. When using the I/O specific com-
mands IN and OUT, the I/O addresses $00
–
$3F must be used. When addressing I/O
registers as SRAM, $20 must be added to these addresses.
For compatibility with future devices, reserved bits should be written to
“
0
”
if accessed.
Reserved I/O memory addresses should never be written.
Some of the status flags are cleared by writing a logical
“
1
”
to them. Note that the CBI
and SBI instructions will operate on all bits in the I/O register, writing a
“
1
”
back into any
flag read as set, thus clearing the flag. The CBI and SBI instructions work with registers
$00 to $1F only.
The I/O and peripherals control registers are explained in the following sections.
System Clock
Write
Read
Data
Data
Address
Address
T1
T2
T3
T4
Prev. Address
R
W
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PDF描述 |
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