参数资料
| 型号： | AT87C54X2-SLRUM |
| 厂商： | Atmel |
| 文件页数： | 48/62页 |
| 文件大小： | 0K |
| 描述： | MCU 8051 16K EPROM 44PLCC |
| 标准包装： | 500 |
| 系列： | 87C |
| 核心处理器： | 8051 |
| 芯体尺寸： | 8-位 |
| 速度： | 40/20MHz |
| 连通性： | UART/USART |
| 外围设备： | POR，WDT |
| 输入/输出数： | 32 |
| 程序存储器容量： | 16KB（16K x 8） |
| 程序存储器类型： | OTP |
| RAM 容量： | 256 x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 4.5 V ~ 5.5 V |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 44-LCC（J 形引线） |
| 包装： | 带卷 (TR) |
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52
4431E–8051–04/06
AT/TS8xC54/8X2
19.5.6
External Data Memory Read Cycle
Figure 19-8. External Data Memory Read Cycle
19.5.7
Serial Port Timing - Shift Register Mode
Table 19-11. Symbol Description
Table 19-12. AC Parameters for a Fix Clock
ALE
PSEN
RD
PORT 0
PORT 2
A0-A7
DATA IN
ADDRESS
OR SFR-P2
T
AVWL
T
LLWL
T
RLAZ
ADDRESS A8-A15 OR SFR P2
T
RHDZ
T
WHLH
TRLRH
T
LLDV
T
RHDX
TAVDV
T
LLAX
TRLDV
Symbol
Parameter
TXLXL
Serial port clock cycle time
T
QVHX
Output data set-up to clock rising edge
T
XHQX
Output data hold after clock rising edge
TXHDX
Input data hold after clock rising edge
TXHDV
Clock rising edge to input data valid
Speed
-M
40 MHz
-V
X2 mode
30 MHz
60 MHz equiv.
-V
standard mode 40
MHz
-L
X2 mode
20 MHz
40 MHz equiv.
-L
standard mode
30 MHz
Units
Symbol
Min
Max
Min
Max
Min
Max
Min
Max
Min
Max
TXLXL
300
200
300
400
ns
TQVHX
200
117
200
283
ns
TXHQX
30
13
30
47
ns
T
XHDX
0000
0
ns
TXHDV
117
34
117
200
ns
相关PDF资料 |
PDF描述 |
|---|---|
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参数描述 |
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