参数资料
型号: AT89C5130A-PUTUM
厂商: Atmel
文件页数: 188/188页
文件大小: 0K
描述: IC 8051 MCU FLASH 16K USB 32QFN
产品培训模块: MCU Product Line Introduction
标准包装: 1,300
系列: AT89C513x
核心处理器: C52X2
芯体尺寸: 8-位
速度: 48MHz
连通性: I²C,SPI,UART/USART,USB
外围设备: LED,POR,PWM,WDT
输入/输出数: 18
程序存储器容量: 16KB(16K x 8)
程序存储器类型: 闪存
EEPROM 大小: 4K x 8
RAM 容量: 1.25K x 8
电压 - 电源 (Vcc/Vdd): 2.7 V ~ 5.5 V
振荡器型: 内部
工作温度: -40°C ~ 85°C
封装/外壳: 32-VQFN 裸露焊盘
包装: 托盘
配用: AT89OCD-01-ND - USB EMULATOR FOR AT8XC51 MCU
其它名称: AT89C5130A-PUTIM
AT89C5130A-PUTIM-ND
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4337K–USB–04/08
AT89C5130A/31A-M
Mode Fault flag, MODF: This bit becomes set to indicate that the level on the SS is inconsistent
with the mode of the SPI. MODF with SSDIS reset, generates receiver/error CPU interrupt
requests.
Figure 19-7 gives a logical view of the above statements.
Figure 19-7. SPI Interrupt Requests Generation
19.3.5
Registers
There are three registers in the module that provide control, status and data storage functions. These registers are
describes in the following paragraphs.
19.3.5.1
Serial Peripheral Control Register (SPCON)
The Serial Peripheral Control Register does the following:
– Selects one of the Master clock rates
– Configure the SPI module as Master or Slave
– Selects serial clock polarity and phase
– Enables the SPI module
– Frees the SS pin for a general-purpose
Table 19-3 describes this register and explains the use of each bit.
Table 19-3.
SPCON Register
SSDIS
MODF
CPU Interrupt Request
SPI Receiver/Error
CPU Interrupt Request
SPI Transmitter
SPI
CPU Interrupt Request
SPIF
7
6
5
4
3
2
1
0
SPR2
SPEN
SSDIS
MSTR
CPOL
CPHA
SPR1
SPR0
Bit
Number
Bit Mnemonic
Description
7
SPR2
Serial Peripheral Rate 2
Bit with SPR1 and SPR0 define the clock rate.
6
SPEN
Serial Peripheral Enable
Cleared to disable the SPI interface.
Set to enable the SPI interface.
5
SSDIS
SS Disable
Cleared to enable SS in both Master and Slave modes.
Set to disable SS in both Master and Slave modes. In Slave mode, this bit has no
effect if CPHA = “0”.
4
MSTR
Serial Peripheral Master
Cleared to configure the SPI as a Slave.
Set to configure the SPI as a Master.
3
CPOL
Clock Polarity
Cleared to have the SCK set to “0” in idle state.
Set to have the SCK set to “1” in idle state.
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PDF描述
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