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参数资料
型号： AT89C5131A-TISUL
厂商： Atmel
文件页数： 79/185页
文件大小： 0K
描述： MCU 8051 32K FLASH USB 28-SOIC
产品培训模块： MCU Product Line Introduction
标准包装： 972
系列： AT89C513x
核心处理器： C52X2
芯体尺寸： 8-位
速度： 48MHz
连通性： I²C，SPI，UART/USART，USB
外围设备： LED，POR，PWM，WDT
输入/输出数： 18
程序存储器容量： 32KB（32K x 8）
程序存储器类型： 闪存
EEPROM 大小： 4K x 8
RAM 容量： 1.25K x 8
电压 - 电源 (Vcc/Vdd)： 3 V ~ 3.6 V
振荡器型： 内部
工作温度： -40°C ~ 85°C
封装/外壳： 28-SOIC（0.295"，7.50mm 宽）
包装： 管件
配用： AT89STK-10-ND - KIT EVAL APPL MASS STORAGE
AT89STK-05-ND - KIT STARTER FOR AT89C5131
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17
AT89C5131A-L
4338F–USB–08/07
Table 15. CKCON1 (S:AFh)
Clock Control Register 1
Reset Value = 0000 0000b
Table 16. PLLCON (S:A3h)
PLL Control Register
Reset Value = 0000 0000b
Table 17. PLLDIV (S:A4h)
PLL Divider Register
Reset Value = 0000 0000
7
6
5
4
3
2
1
0
-
SPIX2
Bit Number
Bit
Mnemonic Description
7-1
-
Reserved
The value read from this bit is always 0. Do not set this bit.
0
SPIX2
SPI Clock
This control bit is validated when the CPU clock X2 is set. When X2 is low,
this bit has no effect.
Clear to select 6 clock periods per peripheral clock cycle.
Set to select 12 clock periods per peripheral clock cycle.
7
6
5
4
3
2
1
0
-
EXT48
PLLEN
PLOCK
Bit Number
Bit
Mnemonic Description
7-3
-
Reserved
The value read from this bit is always 0. Do not set this bit.
2
EXT48
External 48 MHz Enable Bit
Set this bit to bypass the PLL and disable the crystal oscillator.
Clear this bit to select the PLL output as USB clock and to enable the crystal
oscillator.
1
PLLEN
PLL Enable Bit
Set to enable the PLL.
Clear to disable the PLL.
0
PLOCK
PLL Lock Indicator
Set by hardware when PLL is locked.
Clear by hardware when PLL is unlocked.
7
6
5
4
3
2
1
0
R3
R2
R1
R0
N3
N2
N1
N0
Bit Number
Bit
Mnemonic Description
7-4
R3:0
PLL R Divider Bits
3-0
N3:0
PLL N Divider Bits
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