参数资料
型号: AT89LP3240-20AU
厂商: Atmel
文件页数: 72/200页
文件大小: 0K
描述: MCU 8051 32K FLASH 20MHZ
标准包装: 160
系列: 89LP
核心处理器: 8051
芯体尺寸: 8-位
速度: 20MHz
连通性: I²C,SPI,UART/USART
外围设备: 欠压检测/复位,POR,PWM,WDT
输入/输出数: 38
程序存储器容量: 32KB(32K x 8)
程序存储器类型: 闪存
EEPROM 大小: 8K x 8
RAM 容量: 4.25K x 8
电压 - 电源 (Vcc/Vdd): 2.4 V ~ 3.6 V
数据转换器: A/D 8x10b
振荡器型: 内部
工作温度: -40°C ~ 85°C
封装/外壳: 44-TQFP
包装: 托盘
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3706C–MICRO–2/11
AT89LP3240/6440
25.4
Status Register
The current state of the memory may be accessed by reading the status register. The status reg-
ister is shown in Table 25-3.
25.5
DATA Polling
The AT89LP3240/6440 implements DATA polling to indicate the end of a programming cycle.
While the device is busy, any attempted read of the last byte written will return the data byte with
the MSB complemented. Once the programming cycle has completed, the true value will be
accessible. During Erase the data is assumed to be FFH and DATA polling will return 7FH.
When writing multiple bytes in a page, the DATA value will be the last data byte loaded before
programming begins, not the written byte with the highest physical address within the page.
25.6
Flash Security
The AT89LP3240/6440 provides two Lock Bits for Flash Code and Data Memory security. Lock
bits can be left unprogrammed (FFh) or programmed (00h) to obtain the protection levels listed
in Table 25-4. Lock bits can only be erased (set to FFh) by Chip Erase. Lock bit mode 2 disables
programming of all memory spaces, including the User Signature Array and User Configuration
Fuses. User fuses must be programmed before enabling Lock bit mode 2 or 3. Lock bit mode 3
implements mode 2 and also blocks reads from the code and data memories; however, reads of
the User Signature Array, Atmel Signature Array, and User Configuration Fuses are still allowed.
The Lock Bits will not disable FDATA or IAP programming initiated by the application software.
Table 25-3.
Status
Register
––
LOAD
SUCCESS
WRTINH
BUSY
Bit
7
6
543
21
0
Symbol
Function
LOAD
Load flag. Cleared low by the load page buffer command and set high by the next memory write. This flag signals that
the page buffer was previously loaded with data by the load page buffer command.
SUCCESS
Success flag. Cleared low at the start of a programming cycle and will only be set high if the programming cycle
completes without interruption from the brownout detector.
WRTINH
Write Inhibit flag. Cleared low by the brownout detector (BOD) whenever programming is inhibited due to VDD falling
below the minimum required programming voltage. If a BOD episode occurs during programming, the SUCCESS flag
will remain low after the cycle is complete.
BUSY
Busy flag. Cleared low whenever the memory is busy programming or if write is currently inhibited.
Table 25-4.
Lock Bit Protection Modes
Program Lock Bits (by address)
Mode
00h
01h
Protection Mode
1
FFh
No program lock features
200h
FFh
Further programming of the Flash is disabled
3
00h
Further programming of the Flash is disabled and verify (read) is also
disabled; OCD is disabled
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参数描述
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