参数资料
型号: AT89LS53-12PC
厂商: Atmel
文件页数: 33/35页
文件大小: 0K
描述: IC MICRO CTRL 12MHZ 40DIP
标准包装: 9
系列: 89LS
核心处理器: 8051
芯体尺寸: 8-位
速度: 12MHz
连通性: SPI,UART/USART
外围设备: POR,WDT
输入/输出数: 32
程序存储器容量: 12KB(12K x 8)
程序存储器类型: 闪存
RAM 容量: 256 x 8
电压 - 电源 (Vcc/Vdd): 2.7 V ~ 6 V
振荡器型: 内部
工作温度: 0°C ~ 70°C
封装/外壳: 40-DIP(0.600",15.24mm)
包装: 管件
其它名称: AT89LS5312PC
7
AT89LS53
0851C–MICRO–3/06
Dual Data Pointer Registers To facilitate accessing exter-
nal data memory, two banks of 16 bit Data Pointer Regis-
ters are provided: DP0 at SFR address locations 82H-83H
and DP1 at 84H-85H. Bit DPS = 0 in SFR WCON selects
DP0 and DPS = 1 selects DP1. The user should always ini-
talize the DPS bit to the appropriate value before accessing
the respective Data Pointer register.
Power Off Flag The Power Off Flag (POF) is located at
bit_4 (PCON.4) in the PCON SFR. POF is set to “1” during
power up. It can be set and reset under software control
and is not affected by RESET.
Table 3. WCON—Watchdog Control Register
WCON Address = 96H
Reset Value = 0000 0010B
PS2
PS1
PS0
reserved
DPS
WDTRST
WDTEN
Bit
7
65
432
10
Symbol
Function
PS2
PS1
PS0
Prescaler Bits for the Watchdog Timer. When all three bits are set to “0”, the watchdog timer has a nominal
period of 16 ms. When all three bits are set to “1”, the nominal period is 2048 ms.
DPS
Data Pointer Register Select. DPS = 0 selects the first bank of Data Pointer Register, DP0, and DPS = 1
selects the second bank, DP1
WDTRST
Watchdog Timer Reset. Each time this bit is set to “1” by user software, a pulse is generated to reset the
watchdog timer. The WDTRST bit is then automatically reset to “0” in the next instruction cycle. The
WDTRST bit is Write-Only.
WDTEN
Watchdog Timer Enable Bit. WDTEN = 1 enables the watchdog timer and WDTEN = 0 disables the
watchdog timer.
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