参数资料
型号: ATA8741-PXQW
厂商: Atmel
文件页数: 144/238页
文件大小: 3937K
描述: MCU W/TRANSMITTER ASK/FSK 24QFN
产品培训模块: MCU Product Line Introduction
标准包装: 6,000
频率: 310MHz ~ 350MHz
应用: 家庭自动化,遥感,RKE
调制或协议: ASK,FSK
数据传输率 - 最大: 32 kBit/s
功率 - 输出: 6dBm ~ 10.5dBm
电流 - 传输: 9.8mA
数据接口: PCB,表面贴装
天线连接器: PCB,表面贴装
存储容量: 4kB 闪存,256B EEPROM,256B SRAM
电源电压: 2 V ~ 4 V
工作温度: -40°C ~ 85°C
封装/外壳: 24-VQFN 裸露焊盘
包装: 带卷 (TR)
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144
9140CINDCO02/10
ATA8741
Figure 23-5.  Two-wire Mode, Typical Timing Diagram
Referring to the timing diagram (Figure 23-5 on page 144), a bus transfer involves the following
steps:
1.  The a start condition is generated by the Master by forcing the SDA low line while the
SCL line is high (A). SDA can be forced low either by writing a zero to bit 7 of the Shift
Register, or by setting the corresponding bit in the PORT Register to zero. Note that the
Data Direction Register bit must be set to one for the output to be enabled. The slave
devices start detector logic (Figure 23-6 on page 144) detects the start condition and
sets the USISIF Flag. The flag can generate an interrupt if necessary.
2.  In addition, the start detector will hold the SCL line low after the Master has forced an
negative edge on this line (B). This allows the Slave to wake up from sleep or complete
its other tasks before setting up the Shift Register to receive the address. This is done by
clearing the start condition flag and reset the counter.
3.  The Master set the first bit to be transferred and releases the SCL line (C). The Slave
samples the data and shift it into the Serial Register at the positive edge of the SCL
clock.
4.  After eight bits are transferred containing slave address and data direction (read or
write), the Slave counter overflows and the SCL line is forced low (D). If the slave is not
the one the Master has addressed, it releases the SCL line and waits for a new start
condition.
5.  If the Slave is addressed it holds the SDA line low during the acknowledgment cycle
before holding the SCL line low again (i.e., the Counter Register must be set to 14 before
releasing SCL at (D)). Depending of the R/W bit the Master or Slave enables its output. If
the bit is set, a master read operation is in progress (i.e., the slave drives the SDA line)
The slave can hold the SCL line low after the acknowledge (E).
6.  Multiple bytes can now be transmitted, all in same direction, until a stop condition is given
by the Master (F). Or a new start condition is given.
If the Slave is not able to receive more data it does not acknowledge the data byte it has last
received. When the Master does a read operation it must terminate the operation by force the
acknowledge bit low after the last byte transmitted.
Figure 23-6.  Start Condition Detector, Logic Diagram
P
S
ADDRESS
1 - 7
8
9
R/W
ACK
ACK
1 - 8
9
DATA
ACK
1 - 8
9
DATA
DA
CL
A
B
D
E
C
F
SDA
SCL
ri
I  IF
CLOCK
HOLD
USISIF
D  Q
CLR
D  Q
CLR
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PDF描述
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ATA8742C-PXQW 功能描述:8位微控制器 -MCU RoHS:否 制造商:Silicon Labs 核心:8051 处理器系列:C8051F39x 数据总线宽度:8 bit 最大时钟频率:50 MHz 程序存储器大小:16 KB 数据 RAM 大小:1 KB 片上 ADC:Yes 工作电源电压:1.8 V to 3.6 V 工作温度范围:- 40 C to + 105 C 封装 / 箱体:QFN-20 安装风格:SMD/SMT
ATA8742C-PXQW-1 功能描述:EMBEDDED INCL RF TX FOR 433 MHZ 制造商:microchip technology 系列:- 包装:剪切带(CT) 零件状态:在售 频率:429MHz ~ 439MHz 应用:通用 调制或协议:UHF 数据速率(最大值):32kbps 功率 - 输出:7.5dBm 电流 - 传输:9.8mA 数据接口:SPI 天线连接器:PCB,表面贴装 存储容量:4kB 闪存,256B EEPROM,256B SRAM 特性:- 电压 - 电源:2 V ~ 4 V 工作温度:-40°C ~ 85°C 封装/外壳:24-VQFN 裸露焊盘 标准包装:1
ATA8742-PXQW 功能描述:8位微控制器 -MCU Embedded uC incl RF Tx for 433 MHz RoHS:否 制造商:Silicon Labs 核心:8051 处理器系列:C8051F39x 数据总线宽度:8 bit 最大时钟频率:50 MHz 程序存储器大小:16 KB 数据 RAM 大小:1 KB 片上 ADC:Yes 工作电源电压:1.8 V to 3.6 V 工作温度范围:- 40 C to + 105 C 封装 / 箱体:QFN-20 安装风格:SMD/SMT