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参数资料
| 型号： | ATMEGA128A-MUR |
| 厂商： | Atmel |
| 文件页数： | 155/386页 |
| 文件大小： | 0K |
| 描述： | MCU AVR 128K FLASH 16MHZ 64QFN |
| 产品培训模块： | megaAVR Introduction |
| 标准包装： | 4,000 |
| 系列： | AVR® ATmega |
| 核心处理器： | AVR |
| 芯体尺寸： | 8-位 |
| 速度： | 16MHz |
| 连通性： | EBI/EMI，I²C，SPI，UART/USART |
| 外围设备： | 欠压检测/复位，POR，PWM，WDT |
| 输入/输出数： | 53 |
| 程序存储器容量： | 128KB（64K x 16） |
| 程序存储器类型： | 闪存 |
| EEPROM 大小： | 4K x 8 |
| RAM 容量： | 4K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 2.7 V ~ 5.5 V |
| 数据转换器： | A/D 8x10b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 64-VFQFN 裸露焊盘 |
| 包装： | 带卷 (TR) |
| 其它名称： | ATMEGA128A-MUR-ND |
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238
8151H–AVR–02/11
ATmega128A
23.5.1
Differential Gain Channels
When using differential gain channels, certain aspects of the conversion need to be taken into
consideration.
Differential conversions are synchronized to the internal clock CK
ADC2 equal to half the ADC
clock. This synchronization is done automatically by the ADC interface in such a way that the
sample-and-hold occurs at a specific edge of CK
ADC2. A conversion initiated by the user (that is,
all single conversions, and the first free running conversion) when CK
ADC2 is low will take the
same amount of time as a single ended conversion (13 ADC clock cycles from the next pres-
caled clock cycle). A conversion initiated by the user when CK
ADC2 is high will take 14 ADC clock
cycles due to the synchronization mechanism. In free running mode, a new conversion is initi-
ated immediately after the previous conversion completes, and since CK
ADC2 is high at this time,
all automatically started (that is, all but the first) free running conversions will take 14 ADC clock
cycles.
The gain stage is optimized for a bandwidth of 4kHz at all gain settings. Higher frequencies may
be subjected to non-linear amplification. An external low-pass filter should be used if the input
signal contains higher frequency components than the gain stage bandwidth. Note that the ADC
clock frequency is independent of the gain stage bandwidth limitation. For example the ADC
clock period may be 6 s, allowing a channel to be sampled at 12 kSPS, regardless of the band-
width of this channel.
23.6
Changing Channel or Reference Selection
The MUXn and REFS1:0 bits in the ADMUX Register are single buffered through a temporary
register to which the CPU has random access. This ensures that the channels and reference
selection only takes place at a safe point during the conversion. The channel and reference
selection is continuously updated until a conversion is started. Once the conversion starts, the
channel and reference selection is locked to ensure a sufficient sampling time for the ADC. Con-
tinuous updating resumes in the last ADC clock cycle before the conversion completes (ADIF in
ADCSRA is set). Note that the conversion starts on the following rising ADC clock edge after
ADSC is written. The user is thus advised not to write new channel or reference selection values
to ADMUX until one ADC clock cycle after ADSC is written.
Special care should be taken when changing differential channels. Once a differential channel
has been selected, the gain stage may take as much as 125 s to stabilize to the new value.
Thus conversions should not be started within the first 125 s after selecting a new differential
channel. Alternatively, conversion results obtained within this period should be discarded.
The same settling time should be observed for the first differential conversion after changing
ADC reference (by changing the REFS1:0 bits in ADMUX).
If the JTAG Interface is enabled, the function of ADC channels on PORTF7:4 is overridden.
Table 23-1.
ADC Conversion Time
Condition
Sample & Hold (Cycles from Start
of Conversion)
Conversion Time
(Cycles)
First conversion
13.5
25
Normal conversions, single ended
1.5
13
Normal conversions, differential
1.5/2.5
13/14
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相关代理商/技术参数 |
参数描述 |
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| ATMEGA128L | 制造商:ATMEL 制造商全称:ATMEL Corporation 功能描述:8-bit Microcontroller with 128K Bytes In-System Programmable Flash |
| ATMEGA128L8AC | 制造商:Atmel Corporation 功能描述: |
| ATMEGA128L-8AC | 功能描述:8位微控制器 -MCU AVR 1K FLSH 64B EE 64B SRAM ADC 8MHZ RoHS:否 制造商:Silicon Labs 核心:8051 处理器系列:C8051F39x 数据总线宽度:8 bit 最大时钟频率:50 MHz 程序存储器大小:16 KB 数据 RAM 大小:1 KB 片上 ADC:Yes 工作电源电压:1.8 V to 3.6 V 工作温度范围:- 40 C to + 105 C 封装 / 箱体:QFN-20 安装风格:SMD/SMT |
| ATMEGA128L-8AI | 功能描述:8位微控制器 -MCU AVR 1K FLSH 64B EE 64B SRAM ADC 8MHZ RoHS:否 制造商:Silicon Labs 核心:8051 处理器系列:C8051F39x 数据总线宽度:8 bit 最大时钟频率:50 MHz 程序存储器大小:16 KB 数据 RAM 大小:1 KB 片上 ADC:Yes 工作电源电压:1.8 V to 3.6 V 工作温度范围:- 40 C to + 105 C 封装 / 箱体:QFN-20 安装风格:SMD/SMT |
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