参数资料
| 型号： | ATMEGA168V-10MUR |
| 厂商： | Atmel |
| 文件页数： | 339/377页 |
| 文件大小： | 0K |
| 描述： | MCU AVR 16KB FLASH 10MHZ 32QFN |
| 产品培训模块： | MCU Product Line Introduction megaAVR Introduction |
| 标准包装： | 6,000 |
| 系列： | AVR® ATmega |
| 核心处理器： | AVR |
| 芯体尺寸： | 8-位 |
| 速度： | 10MHz |
| 连通性： | I²C，SPI，UART/USART |
| 外围设备： | 欠压检测/复位，POR，PWM，WDT |
| 输入/输出数： | 23 |
| 程序存储器容量： | 16KB（8K x 16） |
| 程序存储器类型： | 闪存 |
| EEPROM 大小： | 512 x 8 |
| RAM 容量： | 1K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 1.8 V ~ 5.5 V |
| 数据转换器： | A/D 8x10b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 32-VFQFN 裸露焊盘 |
| 包装： | 带卷 (TR) |
| 配用： | ATSTK600-TQFP32-ND - STK600 SOCKET/ADAPTER 32-TQFP ATAVRDRAGON-ND - KIT DRAGON FLASH MEM AVR |
| 其它名称： | ATMEGA168V-10MUR-ND |
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64
2545T–AVR–05/11
ATmega48/88/168
Address
Labels Code
Comments
;
.org 0x1C00
0x1C00
jmp
RESET
; Reset handler
0x1C02
jmp
EXT_INT0
; IRQ0 Handler
0x1C04
jmp
EXT_INT1
; IRQ1 Handler
...
;
0x1C32
jmp
SPM_RDY
; Store Program Memory Ready Handler
;
0x1C33
RESET: ldi
r16,high(RAMEND); Main program start
0x1C34
out
SPH,r16
; Set Stack Pointer to top of RAM
0x1C35
ldi
r16,low(RAMEND)
0x1C36
out
SPL,r16
0x1C37
sei
; Enable interrupts
0x1C38
<instr>
xxx
12.4.1
Moving interrupts between application and boot space, Atmel ATmega88 and Atmel ATmega168
The MCU control register controls the placement of the interrupt vector table.
12.5
Register description
12.5.1
MCUCR – MCU control register
Bit 1 – IVSEL: Interrupt vector select
When the IVSEL bit is cleared (zero), the interrupt vectors are placed at the start of the flash
memory. When this bit is set (one), the interrupt vectors are moved to the beginning of the boot
loader section of the flash. The actual address of the start of the boot flash section is determined
by the BOOTSZ fuses. Refer to the section “Boot loader support – Read-while-write self-pro-
gramming, Atmel ATmega88 and Atmel ATmega168” on page 269 for details. To avoid
unintentional changes of interrupt vector tables, a special write procedure must be followed to
change the IVSEL bit:
a.
Write the interrupt vector change enable (IVCE) bit to one.
b.
Within four cycles, write the desired value to IVSEL while writing a zero to IVCE.
Interrupts will automatically be disabled while this sequence is executed. Interrupts are disabled
in the cycle IVCE is set, and they remain disabled until after the instruction following the write to
IVSEL. If IVSEL is not written, interrupts remain disabled for four cycles. The I-bit in the status
register is unaffected by the automatic disabling.
Note:
If interrupt vectors are placed in the boot loader section and boot lock bit BLB02 is programmed,
interrupts are disabled while executing from the Application section. If interrupt vectors are placed
in the Application section and boot lock bit BLB12 is programmed, interrupts are disabled while
executing from the Boot Loader section. Refer to the section “Boot loader support – Read-while-
Boot Lock bits.
This bit is not available in Atmel ATmega48.
Bit
76543
210
–
PUD
–
IVSEL
IVCE
MCUCR
Read/write
R
R/W
R
R/W
Initial value
00000
000
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