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参数资料
| 型号： | ATSAM3X4EA-CU |
| 厂商： | Atmel |
| 文件页数： | 59/71页 |
| 文件大小： | 0K |
| 描述： | IC MCU 2X128KB CORTEX-M3 144-BGA |
| 标准包装： | 160 |
| 系列： | SAM3X |
| 核心处理器： | ARM? Cortex?-M3 |
| 芯体尺寸： | 32-位 |
| 速度： | 84MHz |
| 连通性： | CAN，EBI/EMI，以太网，I²C，IrDA，LIN，MMC，SPI，SSC，UART/USART，USB |
| 外围设备： | 欠压检测/复位，DMA，I²S，POR，PWM，WDT |
| 输入/输出数： | 103 |
| 程序存储器容量： | 256KB（256K x 8） |
| 程序存储器类型： | 闪存 |
| RAM 容量： | 68K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 1.62 V ~ 1.95 V |
| 数据转换器： | A/D 16x12b，D/A 2x12b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 144-LFBGA |
| 包装： | 托盘 |
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11057BS–ATARM–13-Jul-12
SAM3X/A
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11057BS–ATARM–13-Jul-12
SAM3X/A
Automatic Window Comparison of Converted Values
Write Protect Registers
12.11 Digital-to-Analog Converter (DAC)
2 channels, 12-bit DAC
Up to 1 mega-sample conversion rate in single channel mode
Flexible conversion range
Multiple trigger sources for each channel
Built-in offset and gain calibration
Possibility to drive output to ground
Possibility to use as input to analog comparator or ADC (as an internal wire and without S/H
stage)
Two PDCA channels
Power reduction mode
12.12 CAN Controller (CAN)
Fully Compliant with CAN 2.0 Part A and 2.0 Part B
Bit Rates up to 1Mbit/s
8 Object Oriented Mailboxes with the Following Properties:
– CAN Specification 2.0 Part A or 2.0 Part B Programmable for Each Message
– Object Configurable in Receive (with Overwrite or Not) or Transmit Modes
– Independent 29-bit Identifier and Mask Defined for Each Mailbox
– 32-bit Access to Data Registers for Each Mailbox Data Object
– Uses a CAN_SIZE_COUNTER-bit Timestamp on Receive and Transmit Messages
– Hardware Concatenation of ID Masked Bitfields To Speed Up Family ID Processing
16-bit Internal Timer for Timestamping and Network Synchronization
Programmable Reception Buffer Length up to 8 Mailbox Objects
Priority Management between Transmission Mailboxes
Autobaud and Listening Mode
Low Power Mode and Programmable Wake-up on Bus Activity or by the Application
Data, Remote, Error and Overload Frame Handling
12.13 Ethernet MAC (EMAC)
DMA Master on Receive and Transmit Channels
Compatible with IEEE Standard 802.3
10 and 100 Mbit/s operation
Full- and half-duplex operation
Statistics Counter Registers
MII (144-pin SAM3X)/RMII (all SAM3X) interface to the physical layer
Interrupt generation to signal receive and transmit completion
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