参数资料
| 型号： | ATTINY48-AUR |
| 厂商： | Atmel |
| 文件页数： | 21/302页 |
| 文件大小： | 0K |
| 描述： | MCU AVR 4KB FLASH 12MHZ 32TQFP |
| 产品培训模块： | tinyAVR Introduction |
| 标准包装： | 2,000 |
| 系列： | AVR® ATtiny |
| 核心处理器： | AVR |
| 芯体尺寸： | 8-位 |
| 速度： | 12MHz |
| 连通性： | I²C，SPI |
| 外围设备： | 欠压检测/复位，POR，WDT |
| 输入/输出数： | 28 |
| 程序存储器容量： | 4KB（2K x 16） |
| 程序存储器类型： | 闪存 |
| EEPROM 大小： | 64 x 8 |
| RAM 容量： | 256 x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 1.8 V ~ 5.5 V |
| 数据转换器： | A/D 8x10b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 32-TQFP |
| 包装： | 带卷 (TR) |
| 其它名称： | ATTINY48-AUR-ND ATTINY48-AURTR |
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8008H–AVR–04/11
ATtiny48/88
13. Timer/Counter0 and Timer/Counter1 Prescalers
same prescaler module, but the Timer/Counters can have different prescaler settings. The
description below applies to both Timer/Counter1 and Timer/Counter0.
13.1
Internal Clock Source
The Timer/Counter can be clocked directly by the system clock (by setting the CSn[2:0] = 1).
This provides the fastest operation, with a maximum Timer/Counter clock frequency equal to
system clock frequency (f
CLK_I/O). Alternatively, one of four taps from the prescaler can be used
as a clock source. The prescaled clock has a frequency of either f
CLK_I/O/8, fCLK_I/O/64,
f
CLK_I/O/256, or fCLK_I/O/1024.
13.2
Prescaler Reset
The prescaler is free running, i.e., operates independently of the Clock Select logic of the
Timer/Counter, and it is shared by Timer/Counter1 and Timer/Counter0. Since the prescaler is
not affected by the Timer/Counter’s clock select, the state of the prescaler will have implications
for situations where a prescaled clock is used. One example of prescaling artifacts occurs when
the timer is enabled and clocked by the prescaler (CSn[2:0] = 0b010, 0b011, 0b100, or 0b101).
The number of system clock cycles from when the timer is enabled to the first count occurs can
be from 1 to N+1 system clock cycles, where N equals the prescaler divisor (8, 64, 256, or
1024).
It is possible to use the prescaler reset for synchronizing the Timer/Counter to program execu-
tion. However, care must be taken if the other Timer/Counter that shares the same prescaler
also uses prescaling. A prescaler reset will affect the prescaler period for all Timer/Counters it is
connected to.
13.3
External Clock Source
An external clock source applied to the T1/T0 pin can be used as Timer/Counter clock
(clk
T1/clkT0). The T1/T0 pin is sampled once every system clock cycle by the pin synchronization
logic. The synchronized (sampled) signal is then passed through the edge detector. Figure 13-1
shows a functional equivalent block diagram of the T1/T0 synchronization and edge detector
logic. The registers are clocked at the positive edge of the internal system clock (clk
I/O). The latch
is transparent in the high period of the internal system clock.
The edge detector generates one clk
T1/clkT0 pulse for each positive (CSn[2:0] = 7) or negative
(CSn[2:0] = 6) edge it detects.
Figure 13-1. T1/T0 Pin Sampling
The synchronization and edge detector logic introduces a delay of 2.5 to 3.5 system clock cycles
from an edge has been applied to the T1/T0 pin to the counter is updated.
Tn_sync
(To Clock
Select Logic)
Edge Detector
Synchronization
DQ
LE
DQ
Tn
clk
I/O
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| ATTINY48-MMU | 功能描述:8位微控制器 -MCU 4KB In-system Flash 12MHz 1.8V-5.5V RoHS:否 制造商:Silicon Labs 核心:8051 处理器系列:C8051F39x 数据总线宽度:8 bit 最大时钟频率:50 MHz 程序存储器大小:16 KB 数据 RAM 大小:1 KB 片上 ADC:Yes 工作电源电压:1.8 V to 3.6 V 工作温度范围:- 40 C to + 105 C 封装 / 箱体:QFN-20 安装风格:SMD/SMT |
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