参数资料
| 型号： | ATTINY88-15MZ |
| 厂商： | Atmel |
| 文件页数： | 222/245页 |
| 文件大小： | 0K |
| 描述： | IC MCU AVR 8B 8KB FLASH 32QFN |
| 产品培训模块： | tinyAVR Introduction |
| 标准包装： | 5,000 |
| 系列： | AVR® ATtiny |
| 核心处理器： | AVR |
| 芯体尺寸： | 8-位 |
| 速度： | 16MHz |
| 连通性： | I²C，SPI |
| 外围设备： | 欠压检测/复位，POR，WDT |
| 输入/输出数： | 28 |
| 程序存储器容量： | 8KB（4K x 16） |
| 程序存储器类型： | 闪存 |
| EEPROM 大小： | 64 x 8 |
| RAM 容量： | 512 x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 2.7 V ~ 5.5 V |
| 数据转换器： | A/D 8x10b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 125°C |
| 封装/外壳： | 32-VFQFN 裸露焊盘 |
| 包装： | 带卷 (TR) |
| 其它名称： | ATTINY88-15MZ-ND ATTINY88-15MZTR |
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9157C–AVR–03/12
Atmel ATtiny88 Automotive
11.4
Counter Unit
The main part of the 8-bit Timer/Counter is the programmable bi-directional counter unit. Figure
11-2 shows a block diagram of the counter and its surroundings.
Figure 11-2. Counter Unit Block Diagram
Signal description (internal signals):
count
Increment or decrement TCNT0 by 1.
clear
Clear TCNT0 (set all bits to zero).
clk
Tn
Timer/Counter clock, referred to as clk
T0 in the following.
top
Signalize that TCNT0 has reached maximum value.
Depending of the mode of operation used, the counter is cleared or incremented at each timer
clock (clk
T0). clkT0 can be generated from an external or internal clock source, selected by the
Clock Select bits (CS02:0). When no clock source is selected (CS02:0 = 0) the timer is stopped.
However, the TCNT0 value can be accessed by the CPU, regardless of whether clk
T0 is present
or not. A CPU write overrides (has priority over) all counter clear or count operations.
The counting sequence is determined by the setting of the Clear Timer on Compare Match bit
(CTC0) located in the Timer/Counter Control Register (TCCR0A). For more details about
advanced counting sequences, see “Modes of Operation” on page 79.
The Timer/Counter Overflow Flag (TOV0) is set according to the mode of operation selected by
the CTC0 bit. TOV0 can be used for generating a CPU interrupt.
11.5
Output Compare Unit
The 8-bit comparator continuously compares TCNT0 with the Output Compare Registers
(OCR0A and OCR0B). Whenever TCNT0 equals OCR0A or OCR0B, the comparator signals a
match. A match will set the Output Compare Flag (OCF0A or OCF0B) at the next timer clock
cycle. If the corresponding interrupt is enabled, the Output Compare Flag generates an Output
Compare interrupt. The Output Compare Flag is automatically cleared when the interrupt is exe-
cuted. Alternatively, the flag can be cleared by software by writing a logical one to its I/O bit
location.
Figure 11-3 shows a block diagram of the Output Compare unit.
DATA BUS
TCNTn
Control Logic
count
TOVn
(Int.Req.)
Clock Select
top
Tn
Edge
Detector
( From Prescaler )
clk
Tn
clear
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