参数资料
| 型号： | AX250-2PQ208 |
| 厂商： | Microsemi SoC |
| 文件页数： | 246/262页 |
| 文件大小： | 0K |
| 描述： | IC FPGA AXCELERATOR 250K 208QFP |
| 标准包装： | 24 |
| 系列： | Axcelerator |
| 逻辑元件/单元数： | 2816 |
| RAM 位总计： | 55296 |
| 输入/输出数： | 115 |
| 门数： | 250000 |
| 电源电压： | 1.425 V ~ 1.575 V |
| 安装类型： | 表面贴装 |
| 工作温度： | 0°C ~ 70°C |
| 封装/外壳： | 208-BFQFP |
| 供应商设备封装： | 208-PQFP（28x28） |
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Detailed Specifications
2- 70
R e v i sio n 1 8
Global Resource Distribution
At the root of each global resource is a PLL. There are two groups of four PLLs for every device. One
group, located at the center of the north edge (in the I/O ring) of the chip, sources the four HCLKs. The
second group, located at the center of the south edge (again in the I/O ring), sources the four CLKs
(Figure 2-38).
Regardless of the type of global resource, HCLK or CLK, each of the eight resources reach the
ClockTileDist (CTD) Cluster located at the center of every core tile with zero skew. From the
ClockTileDist Cluster, all four HCLKs and four CLKs are distributed through the core tile (Figure 2-39).
Figure 2-38 PLL Group
Figure 2-39 Example of HCLK and CLK Distributions on the AX2000
PLL Cluster
PN
P N
PN
P N
HCLKA HCLKB HCLKC HCLKD
CLKE
PLL
CLKF
CLKG
CLKH
PLL
PLL Group
HCLK
CLK
PLL Group
4
ClockTileDist Cluster
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PDF描述 |
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参数描述 |
|---|---|
| AX250-2PQ208I | 功能描述:IC FPGA AXCELERATOR 250K 208QFP RoHS:否 类别:集成电路 (IC) >> 嵌入式 - FPGA（现场可编程门阵列） 系列:Axcelerator 产品培训模块:Three Reasons to Use FPGA's in Industrial Designs Cyclone IV FPGA Family Overview 特色产品:Cyclone? IV FPGAs 标准包装:60 系列:CYCLONE® IV GX LAB/CLB数:9360 逻辑元件/单元数:149760 RAM 位总计:6635520 输入/输出数:270 门数:- 电源电压:1.16 V ~ 1.24 V 安装类型:表面贴装 工作温度:0°C ~ 85°C 封装/外壳:484-BGA 供应商设备封装:484-FBGA（23x23） |
| AX250-2PQ896 | 制造商:ACTEL 制造商全称:Actel Corporation 功能描述:Axcelerator Family FPGAs |
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