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参数资料
| 型号： | BU-62743B3-112Q |
| 厂商： | DATA DEVICE CORP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 2 CHANNEL(S), 1M bps, MIL-STD-1553 CONTROLLER, BGA128 |
| 封装： | 0.815 X 0.815 INCH, 0.140 INCH HEIGHT, 1 MM PITCH, BGA-128 |
| 文件页数： | 9/93页 |
| 文件大小： | 504K |
| 代理商： | BU-62743B3-112Q |
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Data Device Corporation
62743_pre2.DOC
www.ddc-web.com
8-15-01
17
Table 9. REG2 Fail-Safe Timer Register
(Read 808h)
BIT
DESCRIPTION
31 (MSB)
0
16
0
15
FAIL-SAFE TIMER COUNT - BIT 15 (MSB)
0 (LSB)
FAIL-SAFE TIMER COUNT - BIT 0 (LSB)
FAIL-SAFE TIMER COUNT: Read this register to obtain the current value of the
fail-safe timer. Default is 8400h.
Table 10. REG3 General Purpose Register
(Read/Write 80Ch)
BIT
DESCRIPTION
31 (MSB)
0
16
0
15
FAIL-SAFE TIMER VALUE – BIT 15 (MSB)
0 (LSB)
FAIL-SAFE TIMER VALUE – BIT 0 (LSB)
FAIL-SAFE TIMER VALUE: Write to this register to set the value for the fail-safe
timer. The default value is 8400h. The timer has a 30ns resolution (PCI clock).
The timer is loaded when an access is initiated on the local bus and counts down
until the access is completed. It will time out if it reaches 0. For test purposes,
the failsafe timer can be loaded and decremented via failsafe timer load write
and decrement operations generated through REG7.
Table 11. REG4 Reserved Register
(Read 810h)
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PDF描述 |
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