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参数资料
| 型号： | BU-63825D1-300 |
| 厂商： | DATA DEVICE CORP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 2 CHANNEL(S), 1M bps, MIL-STD-1553 CONTROLLER, CQIP70 |
| 封装： | CERAMIC, DIP-70 |
| 文件页数： | 38/48页 |
| 文件大小： | 405K |
| 代理商： | BU-63825D1-300 |
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43
Data Device Corporation
www.ddc-web.com
BU-63825
C-02/06-0
TABLE 43. BU-63825 PIN LISTING (70-PIN DIP, FLAT PACK)
PIN
X1, X2
X0
PIN
SIGNAL NAME
24
21
16
8
17
12
4
22
19
14
6
10
2
23
20
15
7
11
3
18
13
5
9
1
A01
A04
A07
A15
A06
A11
STRBD
A03
CLOCK_IN
A09
RD/WR
A13
TX/RX-A
RXA
A02
A05
A08
MSTCLR
A12
SELECT
GND
A10
MEM/REG
A14
TX/RX-A
RXA
69
64
56
65
60
52
70
67
62
54
58
50
68
63
55
59
51
66
61
53
57
49
GND
TXA
TRANSPARENT/BUFFERED
D09
INT
D13
D06
-VA (Note 2)
TXA
IOEN
D15
+5V Logic
D11
D04
+5VA
TX_INH_OUT_A
TAG_CLK
D08
D12
D05
READYD
D14
D07
D10
D03
Notes:
1) Pin X0, X1/X2, X3, X6 refer to package option(X) and Voltage Transceiver option (0, 1, 2, 3, 6). See ordering information.
2) -15V for BU-63825X1
-12V for BU-63825X2.
X3
X6
SIGNAL NAME
X1, X2
X0
X3
X6
N/C
TX_INH_IN_A
32
28
30
34
26
31
35
27
29
33
25
DTACK/POLARITY_SEL
MEMENA_OUT
MEMWR/ZERO_WAIT
TX/RX-B
RX-B
DTGRT/MSB/LSB
DTREQ/16/8
TX/RX-B
RX-B
SSFLAG/EXT_TRIG
MEMOE/ADDR_LAT
MEMENA_IN/TRIGGER_SEL
A00
48
45
40
41
36
46
43
38
47
44
39
42
37
D02
INCMD
RTAD1
RTAD2
-VB (Note 2)
TX_INH_OUT_B
D00
RTAD4
+5VB
TXB
D01
RTADP
RTAD0
RTAD3
TXB
GND
N/C
TX_INH_IN_B
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