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参数资料
| 型号： | C8051F005DK-E |
| 厂商： | Silicon Laboratories Inc |
| 文件页数： | 8/12页 |
| 文件大小： | 0K |
| 描述： | DEV KIT FOR C8051F005/F006/F007 |
| 标准包装： | 1 |
C8051F00x/01x-DK
6.5. Expansion I/O Connector (J2)
The 64-pin expansion I/O connector J1 provides access to most signal pins of the C8051F005 device on the target
board. A small through-hole prototyping area is also provided. All I/O signals routed to connector J2 are also routed to
through-hole connection points between J2 and the prototyping area (see Figure 4 on page 9). The signal layout pat-
tern of these connection points is identical to the adjacent J2 connector pins. See Table 5 for a list of pin descrip-
tions for J2.
Table 5: J2 Pin Descriptions
8
Pin
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
Description
+VD (digital voltage supply)
XTAL1
P1.6
P1.7
P1.4
P1.5
P1.2
P1.3
P1.0
P1.1
P0.6
P0.7
P0.4
P0.5
P0.2
P0.3
P0.0
P0.1
P2.6
P2.7
P2.4
P2.5
P2.2
P2.3
P2.0
P2.1
P3.6
Rev. 0.6
Pin
28
29
30
31
32
33
34
36
39,41,42
45,47,63
46,64
48
49
50
51
52
53
54
55
56
57
58
59
60
61
62
Description
P3.7
P3.4
P3.5
P3.2
P3.3
P3.0
P3.1
/RST
GND (digital ground)
GNDA (analog ground)
+VA (analog voltage supply)
DAC0
CP1-
DAC1
CP1+
CP0-
VREF
CP0+
AIN0
AIN1
AIN2
AIN3
AIN4
AIN5
AIN6
AIN7
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参数描述 |
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