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参数资料
| 型号： | C8051F124DK-B |
| 厂商： | Silicon Laboratories Inc |
| 文件页数： | 7/12页 |
| 文件大小： | 0K |
| 描述： | DEV KIT FOR F124/F125/F126/F127 |
| 标准包装： | 1 |
C8051F12x-DK
6.4. Serial Interface (J5)
A RS232 transceiver circuit and DB-9 (J5) connector are provided on the target board to facilitate serial connec-
tions to UART0 of the C8051F120. The TX, RX, RTS and CTS signals of UART0 may be connected to the DB-9
connector and transceiver by installing shorting blocks on headers J6, J8, J9 and J10.
J6
J9
J8
J10
- Install shorting block to connect UART0 TX (P0.0) to the transceiver.
- Install shorting block to connect UART0 RX (P0.1) to the transceiver.
- Install shorting block to connect UART0 RTS (P4.0) to the transceiver.
- Install shorting block to connect UART0 CTS (P4.1) to the transceiver.
6.5.
Analog I/O (J11, J20)
Several C8051F120 analog signals are routed to the J20 terminal block and the J11 header. The J11 connector
provides the ability to connect DAC0 and DAC1 outputs to several different analog inputs by installing a shorting
block between a DAC output and an analog input on adjacent pins of J11. Refer to Table 3 for J20 terminal block
connections and Table 4 for J11 pin definitions.
Table 3. J20 Terminal Block Pin Descriptions
Pin #
1
2
3
4
5
6
7
8
Description
CP0+
CP0-
DAC0
DAC1
AIN0.0
AIN0.1
VREF0
ADND (Analog Ground)
Table 4. J11 Connector Pin Descriptions
Pin #
1
2
3
4
5
6
7
8
9
10
11
12
Description
CP0+
CP0-
DAC0
DAC1
CP1+
CP1-
AIN0.0
AIN0.1
DAC0
DAC1
AIN0.6
AIN0.7
Rev. 0.7
7
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