参数资料
| 型号： | C8051F206 |
| 厂商： | Silicon Laboratories Inc |
| 文件页数： | 18/146页 |
| 文件大小： | 0K |
| 描述： | IC 8051 MCU 8K FLASH 48TQFP |
| 标准包装： | 250 |
| 系列： | C8051F2xx |
| 核心处理器： | 8051 |
| 芯体尺寸： | 8-位 |
| 速度： | 25MHz |
| 连通性： | SPI，UART/USART |
| 外围设备： | 欠压检测/复位，POR，WDT |
| 输入/输出数： | 32 |
| 程序存储器容量： | 8KB（8K x 8） |
| 程序存储器类型： | 闪存 |
| RAM 容量： | 1.25K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 2.7 V ~ 3.6 V |
| 数据转换器： | A/D 32x12b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 48-TQFP |
| 包装： | 托盘 |
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C8051F2xx
114
Rev. 1.6
SFR Definition 15.1. SPI0CFG: SPI Configuration
Bit7:
CKPHA: SPI Clock Phase.
This bit controls the SPI clock phase.
0: Data sampled on first edge of SCK period.
1: Data sampled on second edge of SCK period.
Bit6:
CKPOL: SPI Clock Polarity.
This bit controls the SPI clock polarity.
0: SCK line low in idle state.
1: SCK line high in idle state.
Bits5–3: BC2–BC0: SPI Bit Count.
Indicates which of the up to 8 bits of the SPI word have been transmitted.
Bits2–0:
SPIFRS2–SPIFRS0: SPI Frame Size.
These three bits determine the number of bits to shift in/out of the SPI shift register during a
data transfer in master mode. They are ignored in slave mode.
R/W
R
R/W
Reset Value
CKPHA
CKPOL
BC2
BC1
BC0
SPIFRS2 SPIFRS1 SPIFRS0
00000111
Bit7
Bit6
Bit5
Bit4
Bit3
Bit2
Bit1
Bit0
SFR Address:
0x9A
BC2–BC0
Bit Transmitted
0
Bit 0 (LSB)
001
Bit 1
010
Bit 2
011
Bit 3
100
Bit 4
101
Bit 5
110
Bit 6
1
Bit 7 (MSB)
SPIFRS
Bits Shifted
000
1
001
2
010
3
011
4
100
5
101
6
110
7
111
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