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参数资料
| 型号： | C8051F338-GMR |
| 厂商： | Silicon Laboratories Inc |
| 文件页数： | 10/226页 |
| 文件大小： | 0K |
| 描述： | IC MCU 16K FLASH 24QFN |
| 产品培训模块： | Serial Communication Overview |
| 标准包装： | 1,500 |
| 系列： | C8051F33x |
| 核心处理器： | 8051 |
| 芯体尺寸： | 8-位 |
| 速度： | 25MHz |
| 连通性： | SMBus（2 线/I²C），SPI，UART/USART |
| 外围设备： | POR，PWM，温度传感器，WDT |
| 输入/输出数： | 21 |
| 程序存储器容量： | 16KB（16K x 8） |
| 程序存储器类型： | 闪存 |
| RAM 容量： | 768 x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 2.7 V ~ 3.6 V |
| 数据转换器： | A/D 16x10b; D/A 1x10b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 24-WFQFN 裸露焊盘 |
| 包装： | 带卷 (TR) |
| 其它名称： | Q4962654 T1084322 |
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Rev.1.0
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C8051F336/7/8/9
software prior to entering the Idle mode if the WDT was initially configured to allow this operation. This pro-
vides the opportunity for additional power savings, allowing the system to remain in the Idle mode indefi-
nitely, waiting for an external stimulus to wake up the system. Refer to Section “17.6. PCA Watchdog
Timer Reset” on page 104 for more information on the use and configuration of the WDT.
18.2. Stop Mode
Setting the Stop Mode Select bit (PCON.1) causes the controller core to enter Stop mode as soon as the
instruction that sets the bit completes execution. In Stop mode the internal oscillator, CPU, and all digital
peripherals are stopped; the state of the external oscillator circuit is not affected. Each analog peripheral
(including the external oscillator circuit) may be shut down individually prior to entering Stop Mode. Stop
mode can only be terminated by an internal or external reset. On reset, the device performs the normal
reset sequence and begins program execution at address 0x0000.
If enabled, the Missing Clock Detector will cause an internal reset and thereby terminate the Stop mode.
The Missing Clock Detector should be disabled if the CPU is to be put to in STOP mode for longer than the
MCD timeout of 100 s.
18.3. Suspend Mode
Setting the SUSPEND bit (OSCICN.5) causes the hardware to halt the CPU and the high-frequency inter-
nal oscillator, and go into Suspend mode as soon as the instruction that sets the bit completes execution.
All internal registers and memory maintain their original data. Most digital peripherals are not active in Sus-
pend mode. The exception to this is the Port Match feature and Timer 3, when it is run from an external
oscillator source or the internal low-frequency oscillator.
Suspend mode can be terminated by four types of events, a port match (described in Section “20.5. Port
Match” on page 129), a Timer 3 overflow (described in Section “24.3. Timer 3” on page 196), a Com-
parator low output (if enabled), or a device reset event. Note that in order to run Timer 3 in Suspend mode,
the timer must be configured to clock from either the external clock source or the internal low-frequency
oscillator source. When Suspend mode is terminated, the device will continue execution on the instruction
following the one that set the SUSPEND bit. If the wake event (port match or Timer 3 overflow) was config-
ured to generate an interrupt, the interrupt will be serviced upon waking the device. If Suspend mode is ter-
minated by an internal or external reset, the CIP-51 performs a normal reset sequence and begins
program execution at address 0x0000.
相关PDF资料 |
PDF描述 |
|---|---|
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参数描述 |
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| C8051F340 | 制造商:未知厂家 制造商全称:未知厂家 功能描述:Full Speed USB Flash MCU Family |
| C8051F340_0608 | 制造商:SILABS 制造商全称:SILABS 功能描述:Full Speed USB Flash MCU Family |
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