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参数资料
| 型号： | C8051F343-GM |
| 厂商： | Silicon Laboratories Inc |
| 文件页数： | 96/276页 |
| 文件大小： | 0K |
| 描述： | IC 8051 MCU 32K FLASH MEM 32-QFN |
| 产品培训模块： | Serial Communication Overview |
| 标准包装： | 73 |
| 系列： | C8051F34x |
| 核心处理器： | 8051 |
| 芯体尺寸： | 8-位 |
| 速度： | 48MHz |
| 连通性： | SMBus（2 线/I²C），SPI，UART/USART，USB |
| 外围设备： | 欠压检测/复位，POR，PWM，温度传感器，WDT |
| 输入/输出数： | 25 |
| 程序存储器容量： | 32KB（32K x 8） |
| 程序存储器类型： | 闪存 |
| RAM 容量： | 2.25K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 2.7 V ~ 3.6 V |
| 数据转换器： | A/D 21x10b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 32-VFQFN 裸露焊盘 |
| 包装： | 管件 |
| 配用： | 336-1748-ND - ADAPTER TOOLSTICK FOR C8051F34X |
| 其它名称： | 336-1346-5 |
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Rev. 1.3
185
C8051F340/1/2/3/4/5/6/7/8/9/A/B/C/D
USB Register Definition 16.21. EOUTCSRL: USB0 OUT Endpoint Control Low Byte
Bit7:
CLRDT: Clear Data Toggle
Write:
Software should write ‘1’ to this bit to reset the OUT endpoint data toggle to ‘0’.
Read:
This bit always reads ‘0’.
Bit6:
STSTL: Sent Stall
Hardware sets this bit to ‘1’ when a STALL handshake signal is transmitted. This flag must
be cleared by software.
Bit5:
SDSTL: Send Stall
Software should write ‘1’ to this bit to generate a STALL handshake. Software should write
‘0’ to this bit to terminate the STALL signal. This bit has no effect in ISO mode.
Bit4:
FLUSH: FIFO Flush
Writing a ‘1’ to this bit flushes the next packet to be read from the OUT endpoint FIFO. The
FIFO pointer is reset and the OPRDY bit is cleared. If the FIFO contains multiple packets,
software must write ‘1’ to FLUSH for each packet. Hardware resets the FLUSH bit to ‘0’
when the FIFO flush is complete.
Note: If data for the current packet has already been read from the FIFO, the FLUSH bit should
not be used to flush the packet. Instead, the entire data packet should be read from the
FIFO manually.
Bit3:
DATERR: Data Error
In ISO mode, this bit is set by hardware if a received packet has a CRC or bit-stuffing error.
It is cleared when software clears OPRDY. This bit is only valid in ISO mode.
Bit2:
OVRUN: Data Overrun
This bit is set by hardware when an incoming data packet cannot be loaded into the OUT
endpoint FIFO. This bit is only valid in ISO mode, and must be cleared by software.
0: No data overrun.
1: A data packet was lost because of a full FIFO since this flag was last cleared.
Bit1:
FIFOFUL: OUT FIFO Full
This bit indicates the contents of the OUT FIFO. If double buffering is enabled for the end-
point (DBIEN = ‘1’), the FIFO is full when the FIFO contains two packets. If DBIEN = ‘0’, the
FIFO is full when the FIFO contains one packet.
0: OUT endpoint FIFO is not full.
1: OUT endpoint FIFO is full.
Bit0:
OPRDY: OUT Packet Ready
Hardware sets this bit to ‘1’ and generates an interrupt when a data packet is available. Soft-
ware should clear this bit after each data packet is unloaded from the OUT endpoint FIFO.
W
R/W
R
R/W
R
R/W
Reset Value
CLRDT
STSTL
SDSTL
FLUSH
DATERR
OVRUN
FIFOFUL
OPRDY
00000000
Bit7
Bit6
Bit5
Bit4
Bit3
Bit2
Bit1
Bit0
USB Address:
0x14
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PDF描述 |
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参数描述 |
|---|---|
| C8051F343-GMR | 功能描述:8位微控制器 -MCU 48 MIPS 32KB 10 ADC RoHS:否 制造商:Silicon Labs 核心:8051 处理器系列:C8051F39x 数据总线宽度:8 bit 最大时钟频率:50 MHz 程序存储器大小:16 KB 数据 RAM 大小:1 KB 片上 ADC:Yes 工作电源电压:1.8 V to 3.6 V 工作温度范围:- 40 C to + 105 C 封装 / 箱体:QFN-20 安装风格:SMD/SMT |
| C8051F343-GQ | 功能描述:8位微控制器 -MCU 48 MIPS 32KB 10ADC RoHS:否 制造商:Silicon Labs 核心:8051 处理器系列:C8051F39x 数据总线宽度:8 bit 最大时钟频率:50 MHz 程序存储器大小:16 KB 数据 RAM 大小:1 KB 片上 ADC:Yes 工作电源电压:1.8 V to 3.6 V 工作温度范围:- 40 C to + 105 C 封装 / 箱体:QFN-20 安装风格:SMD/SMT |
| C8051F343-GQR | 功能描述:8位微控制器 -MCU 48 MIPS 32KB 10ADC RoHS:否 制造商:Silicon Labs 核心:8051 处理器系列:C8051F39x 数据总线宽度:8 bit 最大时钟频率:50 MHz 程序存储器大小:16 KB 数据 RAM 大小:1 KB 片上 ADC:Yes 工作电源电压:1.8 V to 3.6 V 工作温度范围:- 40 C to + 105 C 封装 / 箱体:QFN-20 安装风格:SMD/SMT |
| C8051F344 | 制造商:SILABS 制造商全称:SILABS 功能描述:Full Speed USB Flash MCU Family |
| C8051F344-GQ | 功能描述:8位微控制器 -MCU 25 MIPS 64KB 10ADC RoHS:否 制造商:Silicon Labs 核心:8051 处理器系列:C8051F39x 数据总线宽度:8 bit 最大时钟频率:50 MHz 程序存储器大小:16 KB 数据 RAM 大小:1 KB 片上 ADC:Yes 工作电源电压:1.8 V to 3.6 V 工作温度范围:- 40 C to + 105 C 封装 / 箱体:QFN-20 安装风格:SMD/SMT |
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