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参数资料
| 型号： | C8051F350DK |
| 厂商： | Silicon Laboratories Inc |
| 文件页数： | 183/234页 |
| 文件大小： | 0K |
| 描述： | DEV KIT FOR F350/351/352/353 |
| 标准包装： | 1 |
| 类型： | MCU |
| 适用于相关产品： | C8051F350, 351, 352, 353 |
| 所含物品： | 评估板，电源，USB 线缆，适配器和文档 |
| 相关产品： | C8051F353-GMR-ND - IC 8051 MCU 8K FLASH 28MLP C8051F352-GQR-ND - IC 8051 MCU 8K FLASH 32LQFP C8051F351-GMR-ND - IC 8051 MCU 8K FLASH 28MLP C8051F350-GQR-ND - IC 8051 MCU 8K FLASH 32LQFP 336-1273-ND - IC 8051 MCU 8K FLASH 28MLP 336-1272-ND - IC 8051 MCU 8K FLASH 32LQFP 336-1271-ND - IC 8051 MCU 8K FLASH 28MLP 336-1270-ND - IC 8051 MCU 8K FLASH 32LQFP |
| 其它名称： | 336-1083 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页第177页第178页第179页第180页第181页第182页当前第183页第184页第185页第186页第187页第188页第189页第190页第191页第192页第193页第194页第195页第196页第197页第198页第199页第200页第201页第202页第203页第204页第205页第206页第207页第208页第209页第210页第211页第212页第213页第214页第215页第216页第217页第218页第219页第220页第221页第222页第223页第224页第225页第226页第227页第228页第229页第230页第231页第232页第233页第234页
C8051F350/1/2/3
52
Rev. 1.1
SFR Definition 5.6. ADC0DECL: ADC0 Decimation Ratio Register Low Byte
SFR Definition 5.7. ADC0DAC: ADC0 Offset DAC
Bits 7–0: DECI[7:0]: ADC0 Decimation Ratio Register, Bits 7–0.
This register contains the low byte of the 11-bit ADC Decimation Ratio. The decimation ratio
determines the number of modulator input samples used to generate a single output word
from the ADC.
The ADC0 decimation ratio is defined as:
Decimation Ratio = DECI[10:0] + 1
The corresponding sampling period and output word rate of ADC0 is:
ADC0 Conversion Period = [(DECI[10:0] + 1) * 128] / MDCLK
ADC0 Output Word Rate = MDCLK / [128 * (DECI[10:0] + 1)]
The minimum decimation ratio setting is 20. Any register setting below 19 will automatically
be interpreted as 19.
Important: When using the fast filter, the decimation ratio must be divisible by 8
(DECI[2:0] = 111b).
This SFR can only be modified when ADC0 is in IDLE mode.
R/W
Reset Value
DECI7
DECI6
DECI5
DECI4
DECI3
DECI2
DECI1
DECI0
11111111
Bit7
Bit6
Bit5
Bit4
Bit3
Bit2
Bit1
Bit0
SFR Address:
0x9A
Bits 7–0: ADC0DAC: ADC0 PGA Offset DAC Magnitude.
This register determines the ADC0 Offset DAC Magnitude. The value in the offset DAC is a
signed-magnitude representation. Bit 7 represents the sign value (0 = positive, 1 = nega-
tive), while Bits 6–0 represent the magnitude.
This SFR can only be modified when ADC0 is in IDLE mode.
R/W
Reset Value
ADC0DAC
00000000
Bit7
Bit6
Bit5
Bit4
Bit3
Bit2
Bit1
Bit0
SFR Address:
0xBF
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参数描述 |
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| C8051F350R | 功能描述:8位微控制器 -MCU 24-bit ADC RoHS:否 制造商:Silicon Labs 核心:8051 处理器系列:C8051F39x 数据总线宽度:8 bit 最大时钟频率:50 MHz 程序存储器大小:16 KB 数据 RAM 大小:1 KB 片上 ADC:Yes 工作电源电压:1.8 V to 3.6 V 工作温度范围:- 40 C to + 105 C 封装 / 箱体:QFN-20 安装风格:SMD/SMT |
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