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参数资料
| 型号： | C8051F369-GM |
| 厂商： | Silicon Laboratories Inc |
| 文件页数： | 121/288页 |
| 文件大小： | 0K |
| 描述： | IC 8051 MCU 16K FLASH 28-QFN |
| 产品培训模块： | Serial Communication Overview |
| 标准包装： | 73 |
| 系列： | C8051F36x |
| 核心处理器： | 8051 |
| 芯体尺寸： | 8-位 |
| 速度： | 50MHz |
| 连通性： | SMBus（2 线/I²C），SPI，UART/USART |
| 外围设备： | POR，PWM，温度传感器，WDT |
| 输入/输出数： | 25 |
| 程序存储器容量： | 16KB（16K x 8） |
| 程序存储器类型： | 闪存 |
| RAM 容量： | 1K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 2.7 V ~ 3.6 V |
| 数据转换器： | A/D 17x10b; D/A 1x10b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 28-VFQFN 裸露焊盘 |
| 包装： | 托盘 |
| 配用： | 336-1410-ND - KIT DEV FOR C8051F360 FAMILY |
| 其它名称： | 336-1651 |
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Rev. 1.0
207
C8051F360/1/2/3/4/5/6/7/8/9
Figure 18.4 shows the typical SCL generation described by Equation 18.2. Notice that THIGH is typically
twice as large as TLOW. The actual SCL output may vary due to other devices on the bus (SCL may be
extended low by slower slave devices, or driven low by contending master devices). The bit rate when
operating as a master will never exceed the limits defined by equation Equation 18.1.
SCL
Timer Source
Overflows
SCL High Timeout
T
Low
T
High
Figure 18.4. Typical SMBus SCL Generation
Setting the EXTHOLD bit extends the minimum setup and hold times for the SDA line. The minimum SDA
setup time defines the absolute minimum time that SDA is stable before SCL transitions from low-to-high.
The minimum SDA hold time defines the absolute minimum time that the current SDA value remains stable
after SCL transitions from high-to-low. EXTHOLD should be set so that the minimum setup and hold times
meet the SMBus Specification requirements of 250 ns and 300 ns, respectively. Table 18.2 shows the min-
imum setup and hold times for the two EXTHOLD settings. Setup and hold time extensions are typically
necessary when SYSCLK is above 10 MHz.
Table 18.2. Minimum SDA Setup and Hold Times
*Note: Setup Time for ACK bit transmissions and the MSB of all data transfers. The s/w
delay occurs between the time SMB0DAT or ACK is written and when SI is cleared.
Note that if SI is cleared in the same write that defines the outgoing ACK value, s/w
delay is zero.
With the SMBTOE bit set, Timer 3 should be configured to overflow after 25 ms in order to detect SCL low
timeouts (see Section “18.3.3. SCL Low Timeout” on page 204). The SMBus interface will force Timer 3 to
reload while SCL is high, and allow Timer 3 to count when SCL is low. The Timer 3 interrupt service routine
should be used to reset SMBus communication by disabling and re-enabling the SMBus.
SMBus Free Timeout detection can be enabled by setting the SMBFTE bit. When this bit is set, the bus will
be considered free if SDA and SCL remain high for more than 10 SMBus clock source periods (see
Figure 18.4). When a Free Timeout is detected, the interface will respond as if a STOP was detected (an
interrupt will be generated, and STO will be set).
EXTHOLD
Minimum SDA Setup Time
Minimum SDA Hold Time
0
Tlow – 4 system clocks
or
1 system clock + s/w delay*
3 system clocks
1
11 system clocks
12 system clocks
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
|---|---|
| C8051F369-GM2 | 制造商:SILABS 制造商全称:SILABS 功能描述:Mixed Signal ISP Flash MCU Family |
| C8051F369-GMR | 功能描述:8位微控制器 -MCU 16KB 50MIPS 10ADC 10 DAC 28Pin MCU RoHS:否 制造商:Silicon Labs 核心:8051 处理器系列:C8051F39x 数据总线宽度:8 bit 最大时钟频率:50 MHz 程序存储器大小:16 KB 数据 RAM 大小:1 KB 片上 ADC:Yes 工作电源电压:1.8 V to 3.6 V 工作温度范围:- 40 C to + 105 C 封装 / 箱体:QFN-20 安装风格:SMD/SMT |
| C8051F370-A-DK | 功能描述:开发板和工具包 - 8051 DevKit for C8051F37x MCUs RoHS:否 制造商:Silicon Labs 产品:Development Kits 工具用于评估:C8051F960, Si7005 核心: 接口类型:USB 工作电源电压: |
| C8051F370-A-GM | 功能描述:8位微控制器 -MCU 16KB, ADC, QFN24 MCU w/EEPROM RoHS:否 制造商:Silicon Labs 核心:8051 处理器系列:C8051F39x 数据总线宽度:8 bit 最大时钟频率:50 MHz 程序存储器大小:16 KB 数据 RAM 大小:1 KB 片上 ADC:Yes 工作电源电压:1.8 V to 3.6 V 工作温度范围:- 40 C to + 105 C 封装 / 箱体:QFN-20 安装风格:SMD/SMT |
| C8051F370-A-GMR | 制造商:Silicon Laboratories Inc 功能描述:16KB, ADC, QFN24 MCU W/EEPROM - Tape and Reel 制造商:Silicon Laboratories Inc 功能描述:IC MCU 8BIT 16KB FLASH 24QFN 制造商:Silicon Laboratories Inc 功能描述:16KB, ADC, QFN24 MCU w/EEPROM |
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