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参数资料
| 型号： | C8051F500-TB |
| 厂商： | Silicon Laboratories Inc |
| 文件页数： | 153/312页 |
| 文件大小： | 0K |
| 描述： | BOARD PROTOTYPE W/C8051F500 |
| 标准包装： | 1 |
| 类型： | MCU |
| 适用于相关产品： | C8051F500 |
| 所含物品： | 板 |
| 相关产品： | 336-1511-5-ND - IC 8051 MCU 64K FLASH 48-QFN 336-1510-ND - IC 8051 MCU 64K FLASH 48-QFP |
| 其它名称： | 336-1526 |
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C8051F50x/F51x
236
Rev. 1.2
23.4.3. Data Register
The SMBus Data register SMB0DAT holds a byte of serial data to be transmitted or one that has just been
received. Software may safely read or write to the data register when the SI flag is set. Software should not
attempt to access the SMB0DAT register when the SMBus is enabled and the SI flag is cleared to logic 0,
as the interface may be in the process of shifting a byte of data into or out of the register.
Data in SMB0DAT is always shifted out MSB first. After a byte has been received, the first bit of received
data is located at the MSB of SMB0DAT. While data is being shifted out, data on the bus is simultaneously
being shifted in. SMB0DAT always contains the last data byte present on the bus. In the event of lost arbi-
tration, the transition from master transmitter to slave receiver is made with the correct data or address in
SMB0DAT.
SFR Address = 0xC2; SMB0DAT = 0x00
23.5. SMBus Transfer Modes
The SMBus interface may be configured to operate as master and/or slave. At any particular time, it will be
operating in one of the following four modes: Master Transmitter, Master Receiver, Slave Transmitter, or
Slave Receiver. The SMBus interface enters Master Mode any time a START is generated, and remains in
Master Mode until it loses an arbitration or generates a STOP. An SMBus interrupt is generated at the end
of all SMBus byte frames. As a receiver, the interrupt for an ACK occurs
before the ACK. As a transmitter,
interrupts occur
after the ACK.
SFR Definition 23.3. SMB0DAT: SMBus Data
Bit
7
6
5
4
3
2
1
0
Name
SMB0DAT[7:0]
Type
R/W
Reset
0
Bit
Name
Function
7:0
SMB0DAT[7:0]
SMBus Data.
The SMB0DAT register contains a byte of data to be transmitted on the SMBus
serial interface or a byte that has just been received on the SMBus serial interface.
The CPU can read from or write to this register whenever the SI serial interrupt flag
(SMB0CN.0) is set to logic 1. The serial data in the register remains stable as long
as the SI flag is set. When the SI flag is not set, the system may be in the process
of shifting data in/out and the CPU should not attempt to access this register.
相关PDF资料 |
PDF描述 |
|---|---|
| SDR-S | SCOTCH CODE REFILL S |
| SK472M016ST | CAP ALUM 4700UF 16V 20% RADIAL |
| 0210490265 | CABLE JUMPER 1.25MM .152M 20POS |
| C8051F005-TB | BOARD PROTOTYPING W/C8051F005 |
| SK101M250ST | CAP ALUM 100UF 250V 20% RADIAL |
相关代理商/技术参数 |
参数描述 |
|---|---|
| C8051F501-GQ | 制造商:Silicon Laboratories Inc 功能描述:64K,50 MIPS,12BADC - Bulk |
| C8051F501-IM | 功能描述:8位微控制器 -MCU 64K 50 MIPS 12bADC 0.5%OSC RoHS:否 制造商:Silicon Labs 核心:8051 处理器系列:C8051F39x 数据总线宽度:8 bit 最大时钟频率:50 MHz 程序存储器大小:16 KB 数据 RAM 大小:1 KB 片上 ADC:Yes 工作电源电压:1.8 V to 3.6 V 工作温度范围:- 40 C to + 105 C 封装 / 箱体:QFN-20 安装风格:SMD/SMT |
| C8051F501-IMR | 功能描述:8位微控制器 -MCU 50 MIPS 64 kB 4 kB SPI UART I2C RoHS:否 制造商:Silicon Labs 核心:8051 处理器系列:C8051F39x 数据总线宽度:8 bit 最大时钟频率:50 MHz 程序存储器大小:16 KB 数据 RAM 大小:1 KB 片上 ADC:Yes 工作电源电压:1.8 V to 3.6 V 工作温度范围:- 40 C to + 105 C 封装 / 箱体:QFN-20 安装风格:SMD/SMT |
| C8051F501-IQ | 功能描述:8位微控制器 -MCU 64K 50 MIPS 12bADC 0.5%OSC RoHS:否 制造商:Silicon Labs 核心:8051 处理器系列:C8051F39x 数据总线宽度:8 bit 最大时钟频率:50 MHz 程序存储器大小:16 KB 数据 RAM 大小:1 KB 片上 ADC:Yes 工作电源电压:1.8 V to 3.6 V 工作温度范围:- 40 C to + 105 C 封装 / 箱体:QFN-20 安装风格:SMD/SMT |
| C8051F501-IQR | 功能描述:8位微控制器 -MCU 50 MIPS 64 kB 4 kB SPI UART I2C RoHS:否 制造商:Silicon Labs 核心:8051 处理器系列:C8051F39x 数据总线宽度:8 bit 最大时钟频率:50 MHz 程序存储器大小:16 KB 数据 RAM 大小:1 KB 片上 ADC:Yes 工作电源电压:1.8 V to 3.6 V 工作温度范围:- 40 C to + 105 C 封装 / 箱体:QFN-20 安装风格:SMD/SMT |
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