参数资料
型号: C8051F503-IQ
厂商: Silicon Laboratories Inc
文件页数: 55/312页
文件大小: 0K
描述: IC 8051 MCU 64K FLASH 32-QFP
应用说明: LIN Bootloader AppNote
产品培训模块: Serial Communication Overview
标准包装: 250
系列: C8051F50x
核心处理器: 8051
芯体尺寸: 8-位
速度: 50MHz
连通性: SMBus(2 线/I²C),SPI,UART/USART
外围设备: POR,PWM,温度传感器,WDT
输入/输出数: 25
程序存储器容量: 64KB(64K x 8)
程序存储器类型: 闪存
RAM 容量: 4.25K x 8
电压 - 电源 (Vcc/Vdd): 1.8 V ~ 5.25 V
数据转换器: A/D 25x12b
振荡器型: 内部
工作温度: -40°C ~ 125°C
封装/外壳: 32-LQFP
包装: 托盘
配用: 336-1527-ND - KIT DEV FOR C8051F50X
其它名称: 336-1516
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C8051F50x/F51x
148
Rev. 1.2
18.2. Configuring the External Memory Interface
Configuring the External Memory Interface consists of five steps:
1. Configure the Output Modes of the associated port pins as either push-pull or open-drain (push-pull is
most common), and skip the associated pins in the crossbar.
2. Configure Port latches to “park” the EMIF pins in a dormant state (usually by setting them to logic 1).
3. Select Multiplexed mode or Non-multiplexed mode.
4. Select the memory mode (on-chip only, split mode without bank select, split mode with bank select, or
off-chip only).
5. Set up timing to interface with off-chip memory or peripherals.
Each of these five steps is explained in detail in the following sections. The Port selection, Multiplexed
mode selection, and Mode bits are located in the EMI0CF register shown in SFR Definition .
18.3. Port Configuration
The External Memory Interface appears on Ports 1, 2, 3, and 4 when it is used for off-chip memory access.
When the EMIF is used, the Crossbar should be configured to skip over the /RD control line (P1.6) and the
/WR control line (P1.7) using the P1SKIP register. When the EMIF is used in multiplexed mode, the Cross-
bar should also skip over the ALE control line (P1.5). For more information about configuring the Crossbar,
EMIF pinout is shown in Table 18.1 on page 149.
The External Memory Interface claims the associated Port pins for memory operations ONLY during the
execution of an off-chip MOVX instruction. Once the MOVX instruction has completed, control of the Port
pins reverts to the Port latches or to the Crossbar settings for those pins. See Section “20. Port Input/Out-
put” on page 177 for more information about the Crossbar and Port operation and configuration.
The Port
latches should be explicitly configured to “park” the External Memory Interface pins in a dormant
state, most commonly by setting them to a logic 1.
During the execution of the MOVX instruction, the External Memory Interface will explicitly disable the driv-
ers on all Port pins that are acting as Inputs (Data[7:0] during a READ operation, for example). The Output
mode of the Port pins (whether the pin is configured as Open-Drain or Push-Pull) is unaffected by the
External Memory Interface operation, and remains controlled by the PnMDOUT registers. In most cases,
the output modes of all EMIF pins should be configured for push-pull mode.
The C8051F500/1/4/5 devices support both the multiplexed and non-multiplexed modes and the
C8051F508/9-F510/1 devices support only multiplexed modes. Accessing off-chip memory is not sup-
ported by the C8051F502/3/6/7 devices.
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