参数资料
型号: C8051F531A-IT
厂商: Silicon Laboratories Inc
文件页数: 7/220页
文件大小: 0K
描述: IC 8051 MCU 8K FLASH 20TSSOP
产品培训模块: Serial Communication Overview
标准包装: 74
系列: C8051F53x
核心处理器: 8051
芯体尺寸: 8-位
速度: 25MHz
连通性: SPI,UART/USART
外围设备: 欠压检测/复位,POR,PWM,温度传感器,WDT
输入/输出数: 16
程序存储器容量: 8KB(8K x 8)
程序存储器类型: 闪存
RAM 容量: 256 x 8
电压 - 电源 (Vcc/Vdd): 1.8 V ~ 5.25 V
数据转换器: A/D 16x12b
振荡器型: 内部
工作温度: -40°C ~ 125°C
封装/外壳: 20-TSSOP(0.173",4.40mm 宽)
包装: 管件
产品目录页面: 622 (CN2011-ZH PDF)
配用: 336-1488-ND - KIT DEV C8051F53XA, C8051F52XA
336-1457-ND - ADAPTER PROG TOOLSTICK F530TPP
336-1456-ND - ADAPTER PROG TOOLSTICK F530MPP
其它名称: 336-1496-5
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C8051F52x/F53x
104
Rev. 1.4
10.5. External Interrupts
The INT0 and INT0 external interrupt sources are configurable as active high or low, edge or level sensi-
tive. The IN0PL (INT0 Polarity) and IN1PL (INT0 Polarity) bits in the IT01CF register select active high or
active low; the IT0 and IT1 bits in TCON (Section “18.1. Timer 0 and Timer 1” on page 182) select level or
edge sensitive. The table below lists the possible configurations.
INT0 and INT0 are assigned to Port pins as defined in the IT01CF register (see SFR Definition 10.5). Note
that INT0 and INT0 Port pin assignments are independent of any Crossbar assignments. INT0 and INT0
will monitor their assigned Port pins without disturbing the peripheral that was assigned the Port pin via the
Crossbar. To assign a Port pin only to INT0 and/or INT0, configure the Crossbar to skip the selected pin(s).
This is accomplished by setting the associated bit in register XBR0 (see Section “13.1. Priority Crossbar
Decoder” on page 122 for complete details on configuring the Crossbar).
In the typical configuration, the external interrupt pins should be skipped in the crossbar and configured as
open-drain with the pin latch set to 1. See Section “13. Port Input/Output” on page 120 for more informa-
tion.
IE0 (TCON.1) and IE1 (TCON.3) serve as the interrupt-pending flags for the INT0 and INT0 external inter-
rupts, respectively. If an INT0 or INT0 external interrupt is configured as edge-sensitive, the corresponding
interrupt-pending flag is automatically cleared by the hardware when the CPU vectors to the ISR. When
configured as level sensitive, the interrupt-pending flag remains logic 1 while the input is active as defined
by the corresponding polarity bit (IN0PL or IN1PL); the flag remains logic 0 while the input is inactive. The
external interrupt source must hold the input active until the interrupt request is recognized. It must then
deactivate the interrupt request before execution of the ISR completes or another interrupt request will be
generated.
IT0
IN0PL
INT0 Interrupt
IT1
IN1PL
INT1 Interrupt
1
0
Active low, edge sensitive
1
0
Active low, edge sensitive
1
Active high, edge sensitive
1
Active high, edge sensitive
0
Active low, level sensitive
0
Active low, level sensitive
0
1
Active high, level sensitive
0
1
Active high, level sensitive
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PDF描述
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参数描述
C8051F531A-ITR 功能描述:8位微控制器 -MCU 25 MIPS 8 kB 256 SPI RoHS:否 制造商:Silicon Labs 核心:8051 处理器系列:C8051F39x 数据总线宽度:8 bit 最大时钟频率:50 MHz 程序存储器大小:16 KB 数据 RAM 大小:1 KB 片上 ADC:Yes 工作电源电压:1.8 V to 3.6 V 工作温度范围:- 40 C to + 105 C 封装 / 箱体:QFN-20 安装风格:SMD/SMT
C8051F531-C-IM 制造商:Silicon Laboratories Inc 功能描述:25 MIPS, 8 KB, 256, SPI, UART, QFN20 - Rail/Tube 制造商:Silicon Laboratories Inc 功能描述:IC MCU 8051 8KB FLASH 20QFN
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