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参数资料
| 型号： | C8051F800-GM |
| 厂商： | Silicon Laboratories Inc |
| 文件页数： | 137/250页 |
| 文件大小： | 0K |
| 描述： | IC MCU 8BIT 16KB FLASH 20QFN |
| 产品培训模块： | Serial Communication Overview |
| 特色产品： | QuickSense? Portfolio |
| 标准包装： | 91 |
| 系列： | C8051F80x |
| 核心处理器： | 8051 |
| 芯体尺寸： | 8-位 |
| 速度： | 25MHz |
| 连通性： | SMBus（2 线/I²C），SPI，UART/USART |
| 外围设备： | 电容感应，POR，PWM，温度传感器，WDT |
| 输入/输出数： | 17 |
| 程序存储器容量： | 16KB（16K x 8） |
| 程序存储器类型： | 闪存 |
| RAM 容量： | 512 x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 1.8 V ~ 3.6 V |
| 数据转换器： | A/D 16x10b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 20-VFQFN 裸露焊盘 |
| 包装： | 管件 |
| 产品目录页面： | 624 (CN2011-ZH PDF) |
| 配用： | 336-1797-ND - KIT DEV C8051F800 336-1824-ND - PLATFORM PROG TOOLSTICK F8XX 336-1825-ND - PLATFORM PROG TOOLSTICK F8XX 336-1822-ND - DAUGHTER CARD C8051F8XX |
| 其它名称： | 336-1766-5 |
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Rev. 1.0
221
C8051F80x-83x
28.2.3. Comparator 0 Capture Mode
The capture mode in Timer 2 allows Comparator 0 rising edges to be captured with the timer clocking from
the system clock or the system clock divided by 12. Timer 2 capture mode is enabled by setting TF2CEN
to 1 and T2SPLIT to 0.
When capture mode is enabled, a capture event will be generated on every Comparator 0 rising edge.
When the capture event occurs, the contents of Timer 2 (TMR2H:TMR2L) are loaded into the Timer 2
reload registers (TMR2RLH:TMR2RLL) and the TF2H flag is set (triggering an interrupt if Timer 2 inter-
rupts are enabled). By recording the difference between two successive timer capture values, the
Comparator 0 period can be determined with respect to the Timer 2 clock. The Timer 2 clock should be
much faster than the capture clock to achieve an accurate reading.
This mode allows software to determine the time between consecutive Comparator 0 rising edges, which
can be used for detecting changes in the capacitance of a capacitive switch, or measuring the frequency of
a low-level analog signal.
Figure 28.6. Timer 2 Capture Mode Block Diagram
SYSCLK
0
1
CKCON
T
3
M
H
T
3
M
L
S
C
A
0
S
C
A
1
T
0
M
T
2
M
H
T
2
M
L
T
1
M
TMR2L
TMR2H
TCLK
TR2
TMR2RLL TMR2RLH
Capture
T
M
R2CN
T2SPLIT
TF2CEN
TF2L
TF2H
T2XCLK
TR2
TF2LEN
TF2CEN
Interrupt
SYSCLK / 12
T2XCLK
External Clock / 8
Comparator 0
Output
0
1
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PDF描述 |
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参数描述 |
|---|---|
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