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参数资料
型号： C8051T600EDB
厂商： Silicon Laboratories Inc
文件页数： 170/188页
文件大小： 0K
描述： BOARD DAUGHTER FOR C8051T600E
标准包装： 1
附件类型： 子板
适用于相关产品： C8051T600
产品目录页面： 626 (CN2011-ZH PDF)
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其它名称： 336-1665
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C8051T600/1/2/3/4/5/6
82
Rev. 1.2
17.2. Interrupt Register Descriptions
The SFRs used to enable the interrupt sources and set their priority level are described in this section.
Refer to the data sheet section associated with a particular on-chip peripheral for information regarding
valid interrupt conditions for the peripheral and the behavior of its interrupt-pending flag(s).
Table 17.1. Interrupt Summary
Interrupt Source
Interrupt
Vector
Priority
Order
Pending Flag
Bit
a
ddre
ssa
ble?
Cl
ea
red
by
H
W
?
Enable
Flag
Priority
Control
Reset
0x0000
Top
None
N/A N/A Always
Enabled
Always
Highest
External Interrupt 0
(INT0)
0x0003
0
IE0 (TCON.1)
Y
EX0 (IE.0) PX0 (IP.0)
Timer 0 Overflow
0x000B
1
TF0 (TCON.5)
Y
ET0 (IE.1) PT0 (IP.1)
External Interrupt 1
(INT1)
0x0013
2
IE1 (TCON.3)
Y
EX1 (IE.2) PX1 (IP.2)
Timer 1 Overflow
0x001B
3
TF1 (TCON.7)
Y
ET1 (IE.3) PT1 (IP.3)
UART0
0x0023
4
RI0 (SCON0.0)
TI0 (SCON0.1)
Y
N
ES0 (IE.4) PS0 (IP.4)
Timer 2 Overflow
0x002B
5
TF2H (TMR2CN.7)
TF2L (TMR2CN.6)
Y
N
ET2 (IE.5) PT2 (IP.5)
SMB0
0x0033
6
SI (SMB0CN.0)
Y
N
ESMB0
(EIE1.0)
PSMB0
(EIP1.0)
ADC0
Window Compare
0x003B
7
AD0WINT (ADC0CN.3) Y
N
EWADC0
(EIE1.1)
PWADC0
(EIP1.1)
ADC0
Conversion Complete
0x0043
8
AD0INT (ADC0CN.5)
Y
N
EADC0
(EIE1.2)
PADC0
(EIP1.2)
Programmable
Counter Array
0x004B
9
CF (PCA0CN.7)
CCFn (PCA0CN.n)
Y
N
EPCA0
(EIE1.3)
PPCA0
(EIP1.3)
Comparator0
Falling Edge
0x0053
10
CP0FIF (CPT0CN.4)
N
ECP0
(EIE1.4)
PCP0
(EIP1.4)
Comparator0
Rising Edge
0x005B
11
CP0RIF (CPT0CN.5)
N
ECP0
(EIE1.5)
PCP0
(EIP1.5)
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PDF描述
ISL9000BJEV2 EVAL BOARD 1.5V/2.8V ISL9000BJ
EEM08DRSD-S664 CONN EDGECARD 16POS DIP .156 SLD
AK2524-R CABLE CD-ROM AUDIO 4POS-3WIRE
0210490329 CABLE JUMPER 1.25MM .127M 26POS
101A062-4-0 BOOT MOLDED
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